【免费】电磁1802-吴叶赛-数字钟1资源-CSDN文库

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《电子线路设计、测试与实验》实验报告

实验一名称：

多功能数字钟

院（系）：

电子信息与通信工程学院

专业班级：

电磁 1802

姓名：

吴叶赛

学号：

时间：

U201813405

2020 年 9 月 16 日

十，输出低电平有效，用以驱动共阳极显示器。

3）动态扫描

动态数码扫描显示方式是利用了人眼的视觉暂留效应，把八个数码管按一定顺序

（从左至右或从右至左）进行点亮，当频率足够大时，我们看到的将是全部同时显示

（点亮），与传统方式得到的视觉效果完全一样。事实上，因为数码管点亮不是瞬间就

可以的，它也需要一定的时间，该时间与数码管的选择有关系。为了折中这一对矛盾，

实验中一般可将计数频率选择在 100Hz 左右可以满足上述两个要求。

4）分频器

该模块的任务是对 100MHz 的时钟信号进行分频，产生 1Hz 的秒脉冲信号，其占

空比为 50%，作为数字钟的计时基准。

设计一个模数为 25×10

6

的二进制递增计数器，其计数范围为 0～24999999，每当

计数器记到最大值时，输出信号翻转一次，即可产生 1Hz 的秒脉冲，其占空比为 50%。

5）计数器设计

计数器分为三种计数器：模 24 计数器，模 10 计数器，模 6 计数器。

I）模 24 计数器将八位寄存器分为两个四位二进制寄存器，分别存储时的个位

和十位。个位范围从 0000 到 1001，1001 的下一位清零，同时十位进 1，当

十位为 2 且个位为 3 时，下一步个位十位同时清零。

II）模 10 计数器使用一个四位二进制寄存器，用于存储分和秒的个位。计数范

围从 0000 到 1001，1001 的下一位清零，同时控制模 6 计数器使能端使其进

1。

III）模 6 计数器使用一个四位二进制寄存器，用于存储分和秒的十位。计数范

围从 0000 到 0101，0101 的下一位清零，同时控制模 24 计数器进 1。

四、实验内容

1）拟定数字钟电路的组成框图，采用分层次、分模块的方法设计电路。

2）使用 Verilog HDL 设计各单元电路并进行仿真分析。

3）用 FPGA 开发板实现数字钟，并实际测试数字钟系统的逻辑功能。

4）根据实验要求，实现闹钟，整点报时和时制切换三个拓展功能。

五、仿真结果

24 小时波形图

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