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基于FPGA的数字乘法器性能比较.pdf
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乘法是数字信号处理中重要的基本运算，在很大程度上影响着系统的性能。本文将介绍三种高速乘法器实现原理：阵列乘法器、华莱士(WT)乘法器、布斯华莱士树超前进位乘法器。而且通过FPGA技术实现了这三种乘法器，并对基于以上三种架构的乘法器性能进行了分析比较。
基于FPGA的数字乘法器性能比较* (2011年)
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详细描述了四种基本的FPGA数字乘法器设计方法即阵列法、查找表法、移位相加法、Booth法的原理和实现过程。以4×4和16×16数字乘法器的设计为例，通过在AlteraFPGA芯片上的仿真与综合，给出了这四种数字乘法器的运算速度和占用逻辑资源情况。结果表明随着位宽的变化，各方法的相对效果会有变化，对于具有较宽数据位的乘法器来说，使用Booth方法有明显的优势，而移位相加法可明显的节省片上硬件资源。
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