夏宇闻著作：从算法设计到硬线逻辑的实现
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2010-03-21
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第5章基本运算逻辑和它们的Verilog HDL模型.doc 246KB 第6章运算和数据流动控制逻辑.doc 164KB 第3章Verilog HDL的基本语法.doc 815KB 第1章数字信号处理、计算、程序、.doc 46KB 第8章CPU设计简介.doc 704KB 第7章有限状态机和可综合风格的Verilog HDL.doc 1MB 第2章Verilog HDL设计方法概述.doc 242KB 第4章不同抽象级别的Verilog HDL模型.doc 411KB 第9章虚拟器件和虚拟接口模型.doc 276KB
第六章 运算和数据流动控制逻辑.pdf 250KB 第四章 不同抽象级别的Verilog HDL模型.pdf 207KB
从算法设计到硬线逻辑的实现.ppt 432KB 第九章 虚拟器件和虚拟接口模型.pdf 340KB 第五章 基本运算逻辑和它们的Verilog HDL模型.pdf 240KB 第七章 有限状态机.pdf 495KB 第二章 Verilog HDL设计方法概述.pdf 196KB 第一章 数字信号处理、计算、程序、.pdf 171KB 第八章 CPU设计简介.pdf 544KB 第三章 Verilog HDL的基本语法.pdf 461KB资源评论
