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本规范的目的是提高书写代码的可读性 可修改性 可重用性 优化代码综合和仿真的结 果 指导设计工程师使用VHDL规范代码和优化电路 规范化公司的ASIC/FPGA设计输入 从而做到 逻辑功能正确 可快速仿真 综合结果最优 可读性较好
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VHDL代码书写规范
1
目 次
13
5.1.12 Comments
........................................................
13
5.1.11.1 FSM 使用规定
................................................
13
5.1.11 FSM
有限状态机
................................................
13
5.1.10.2package 使用注意内容
...........................................
12
5.1.10.1 package 使用建议
..............................................
12
5.1.10 package
..........................................................
12
5.1.9.1 generic 使用注意内容
............................................
12
5.1.9 类属( generics)
......................................................
12
5.1.8.2 procedure 使用注意内容
..........................................
12
5.1.8.1 procedure 使用规定
..............................................
12
5.1.8 procedure
..........................................................
11
5.1.7.3 function 使用注意内容
...........................................
11
5.1.7.2 function 使用建议
...............................................
11
5.1.7.1 function 使用规定
...............................................
11
5.1.7 function
..........................................................
11
5.1.6.2比较运算符规定
................................................
11
5.1.6.1 表达式书写规定
................................................
11
5.1.6 运算符(operator)
....................................................
11
5.1.5.3 VHDL 语句使用注意内容
.........................................
10
5.1.5.2 VHDL 语句使用建议
............................................
7
5.1.5.1 VHDL各语句使用规定
.............................................
7
5.1.5 语句
..............................................................
6
5.1.4.3 实体使用注意内容
...............................................
6
5.1.4.2 实体使用建议
...................................................
4
5.1.4.1 实体
结构体使用规定
...........................................
4
5.1.4 实体
..............................................................
4
5.1.3.3 信号
变量使用注意内容
..........................................
4
5.1.3.2 变量使用建议
...................................................
4
5.1.3.1 信号不许赋初值
...............................................
4
5.1.3 信号和变量
.........................................................
4
5.1.2.3 数据使用注意内容
...............................................
3
5.1.2.2 数据及数据类型使用建议
.........................................
3
5.1.2.1类型使用规定
...................................................
3
5.1.2数据对象和类型
......................................................
3
5.1.1.6 信号命名有关建议
...............................................
2
5.1.1.5 信号名一致性规定
...............................................
2
5.1.1.4 信号名缩写的大小写规定
..........................................
2
5.1.1.3 信号名连贯缩写的规定
............................................
2
5.1.1.2标识符大小写规定
................................................
2
5.1.1.1标识符定义命名规定
..............................................
2
5.1.1 标识符 Identifiers)命名习惯
............................................
1
5.1 VHDL编码风格
..........................................................
1
5
规范内容
..................................................................
1
4
引用标准和参考资料
.........................................................
1
3
定义
.....................................................................
1
2
范围
.....................................................................
1
1
目的
.....................................................................
2
21
6.5 参数化元件实例
.........................................................
20
6.4 程序包书写实例
.........................................................
19
6.3 函数书写实例
..........................................................
17
6.2 VHDL 编写范例
.........................................................
17
6.1 VHDL保留字
...........................................................
16
6
附录
....................................................................
15
5.2.5 多赋值语句案例
三态总线
............................................
15
5.2.4 避免使用Latch
......................................................
15
5.2.3 考虑综合的执行时间
.................................................
14
5.2.2组合逻辑描述的多种方式
..............................................
14
5.2.1 资源共享问题
......................................................
14
5.2 代码编写中容易出现的问题
................................................
13
5.1 代码模块划分
..........................................................
13
5.1.13 TAB键间隔
.......................................................
13
5.1.12.1 Comments 使用建议
............................................
3
VHDL代码书写规范
1
目的
本规范的目的是提高书写代码的可读性 可修改性 可重用性 优化代码综合和仿真的结
果
指导设计工程师使用VHDL规范代码和优化电路 规范化公司的ASIC/FPGA设计输入 从而做
到
逻辑功能正确
可快速仿真
综合结果最优 可读性较好
2 范围
本规范涉及VHDL编码风格 规定 编码中应注意的问题
VHDL代码书写范例等
本规范适用于所有的采用VHDL代码进行设计的项目
3
定义
VHDL Very high speed IC Hardware Description Language, 甚高速集成电路的硬件描述语言
FSM
Finite Status Machine,有限状态机
simulate
仿真 通过输入激励在计算机上验证设计是否正确 包括RTL仿真和门级仿真
模拟 是指对一个物理器件的结构 功能或其他特性如延时特性等用抽象的语言或高级语言
如用C语言进行算法描述 所进行的建模
4
引用标准和参考资料
下列标准包含的条文 通过在本标准中引用而构成本标准的条文 在标准出版时 所示版本
均为有效
所有标准都会被修订 使用本标准的 各方应探讨使用下列标准最新版本的可能性
Mr,Kevin Shahill
USA
VHDL For Programmable Logic
5
规范内容
以下内容中 有关的保留字用黑体标识 对不作为审核的内容用 建议 字眼标识
5.1 VHDL编码风格
本章节中提到的VHDL 编码规则和建议适应于 VHDL 的任何一级
RTL behavioral,
gate_level)
也适用于出于仿真 综合或二者结合的目的而设计的模块
5.1
.1 标识符 Identifiers)命名习惯
1
标识符用于定义实体名 结构体名 信号和变量名等 选择有意义的命名对设计是十分重要
的
命名包含信号或变量诸如出处 有效状态等基本含义 下面给出一些命名的规则 包括
VHDL语言的保留字
5.1
.1.1
标识符定义命名规定
y
标识符第一个字符必须是字母 最后一个字符不能是下划线 不许出现连续两个下划线
y
基本标识符只能由字母 数字和 下划线组成
y
标识符两词之间须用下划线连接
如
Packet_addr, Data_in, Mem_wr, Mem_ce
y
标识符不得与保留字同名
VHDL保留字见附录6.1
5.1
.1.2
标识符大小写规定
y
对常量 数据类型 实体名和结构体名采用全部大写
y
对变量采用小写
y
对信号采用第一个词首字符大写
y
保留字一律小写
5.1
.1.3
信号名连贯缩写的规定
长的名字对书写和记忆会带来不便
甚至带来错误 采用缩写时应注意同一信号在模块中的
一致性
一致性的缩写习惯有利于文件的阅读理解和交流
部分缩写的统一规定为
Addr address Clk clock Clr clear Cnt counter
En enable
Inc increase Lch latch Mem memory
Pntr pointer
Pst preset Rst reset
Reg register
Rd reader Wr write
常用多个单词的缩写
ROM RAM CPU FIFO ALU CS CE
自定义的缩写必须在文件头注释
5.1
.1.4
信号名缩写的大小写规定
y
单词的缩写若是信号名的第一个单词则首字符大写 如
Addr_in中的Addr
若该单词缩写不
是第一 个单词则小写
如 Addr_en 中的en
y
多个单词的首字符缩写都大写 不管该缩写在标识符的什么位置
如 RAM_addr
Rd_CPU_en
5.1
.1.5
信号名一致性规定
同一信号在不同层次应保持一致性
5.1
.1.6
信号命名有关建议
2
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