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布局布线---SoC_Encouter

encounter

布局布线

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描述cadence soc encounter 布局布线的一些注意点和使用技巧

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SOC Encouter 布局布线

2011.01.10

Outline

•

SOC Encounter 简介

•

SOC Encounter 布局 /布线流程

•

布局布线中的参数设置

•

演示

SOC Encounter 简介

SOC Encounter 是 cadence 数字集成电路设计平台

的一个集成的后端工具，功能相当强大，可以从综合，

一直做到生成 GDSII 文件！当然里面集成了很多的工具，

如 RC ， Nanoroute ， FIRE&ICE QXC 等。支持超过

5000 万门 180 纳米以下工艺的层次化设计。

SOC Encounter 采用层次化设计功能将芯片分割成

多个小块 , 以便单独进行设计 , 再重新进行组装。 SOC

Encounter 首先读入 RTL 或门级网表 , 并快速构建可准确

代表最终芯片（包括时序、布线、芯片大小 , 功耗和信号

完整性）的芯片“虚拟原型”。通过使用物理虚拟原型功能 ,

设计师可以快速验证物理可行性并在逻辑上进行必要更改。

SOC Encounter 同 Silicon Ensemble 一样，

也是 Cadence 的自动布线工具。对 Silicon

Ensemble 而言，最多可以做到 0.18 的工艺，

到 0.18 工艺以下，必须使用 SOC Encounter 。

其实，对于 0.25 以上工艺，使用 SOC

Encounter 将会大大方便整个后端设计。

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布局布线---SoC_Encouter

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