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XC7K410T实现UART串口通信【Verilog HDL驱动】 (256个子文件)
__synthesis_is_complete__ 0B
_info 6KB
_info 4KB
_info 149B
_info 149B
_vmake 29B
_vmake 29B
elaborate.bat 1KB
simulate.bat 993B
compile.bat 905B
simulate.bat 834B
compile.bat 828B
runme.bat 305B
runme.bat 305B
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xsim_1.c 9KB
xsim.dbg 26KB
u_ila_0.dcp 595KB
top_uart_packet_routed.dcp 366KB
dbg_hub.dcp 357KB
top_uart_packet_physopt.dcp 334KB
top_uart_packet_placed.dcp 334KB
top_uart_packet_opt.dcp 242KB
top_uart_packet.dcp 104KB
tb_top_uart_packet_compile.do 909B
tb_top_uart_packet_simulate.do 638B
tb_top_uart_packet_wave.do 351B
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exempt0hztjx 388B
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exempt7q67qa 148B
exempt7zk7z5 512KB
exemptdnc3ky 512KB
exemptjtj3ww 200B
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xsim.ini 40B
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webtalk_2892.backup.jou 925B
ISEWrap.js 8KB
ISEWrap.js 8KB
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rundef.js 1KB
runme.log 34KB
runme.log 21KB
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compile.log 2KB
webtalk_1872.backup.log 1009B
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webtalk_20396.backup.log 995B
webtalk_19544.backup.log 995B
webtalk_8980.backup.log 994B
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ss19796.2454110360560.log 540B
xsimkernel.log 348B
simulate.log 50B
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xelab.pb 7KB
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phys_opt_design.pb 2KB
top_uart_packet_power_summary_routed.pb 867B
top_uart_packet_utilization_placed.pb 289B
top_uart_packet_utilization_synth.pb 289B
vivado.pb 149B
top_uart_packet_timing_summary_routed.pb 109B
top_uart_packet_methodology_drc_routed.pb 52B
top_uart_packet_route_status.pb 44B
top_uart_packet_drc_routed.pb 37B
top_uart_packet_drc_opted.pb 37B
top_uart_packet_bus_skew_routed.pb 30B
tb_uart_packet_top_vlog.prj 512B
tb_top_uart_packet_vlog.prj 506B
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_lib.qdb 48KB
_lib.qdb 48KB
_lib.qdb 48KB
_lib1_2.qdb 32KB
共 256 条
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