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单周期cpu设计实验报告
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单周期cpu设计实验报告
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计算机组成原理与接口技术实验
《计算机组成原理与接口技术实验》
实验报告
学 院 名 称
:
数据科学与计算机学院
学 生 姓 名
:
学 号
:
专业(班级)
:
合 作 者
:
时 间
:
2016
年
X
月
X
日
计算机组成原理与接口技术实验
成 绩
:
实 验 二
:
单周期CPU设计
一. 实验目的
(1) 掌握单周期 CPU 数据通路图的构成、原理及其设计方法;
(2) 掌握单周期 CPU 的实现方法,代码实现方法;
(3) 认识和掌握指令与 CPU 的关系;
(4) 掌握测试单周期 CPU 的方法。
二. 实验内容
设计一个单周期 CPU,该 CPU 至少能实现以下指令功能操作。需设计的指令与格
式如下:
==> 算术运算指令
(1)add rd , rs, rt (说明:以助记符表示,是汇编指令;以代码表示,是机器指令)
000000
rs(5 位)
rt(5 位)
rd(5 位)
reserved
功能:rd←rs + rt。reserved 为预留部分,即未用,一般填“0”。
(2)addi rt , rs ,immediate
000001
rs(5 位)
rt(5 位)
immediate(16 位)
功能:rt←rs + (sign-extend)immediate;immediate 符号扩展再参加“加”运算。
(3)sub rd , rs , rt
000010
rs(5 位)
rt(5 位)
rd(5 位)
reserved
完成功能:rd←rs - rt
==> 逻辑运算指令
(4)ori rt , rs ,immediate
010000
rs(5 位)
rt(5 位)
immediate(16 位)
功能:rt←rs | (zero-extend)immediate;immediate 做“0”扩展再参加“或”运算。
(5)and rd , rs , rt
010001
rs(5 位)
rt(5 位)
rd(5 位)
reserved
功能:rd←rs & rt;逻辑与运算。
(6)or rd , rs , rt
010010
rs(5 位)
rt(5 位)
rd(5 位)
reserved
功能:rd←rs | rt;逻辑或运算。
==> 传送指令
(7)move rd , rs
100000
rs(5 位)
00000
rd(5 位)
reserved
功能:rd←rs + $0 ;$0=$zero=0。
==> 存储器读/写指令
(8)sw rt ,immediate(rs) 写存储器
100110
rs(5 位)
rt(5 位)
immediate(16 位)
计算机组成原理与接口技术实验
功能:memory[rs+ (sign-extend)immediate]←rt;immediate 符号扩展再相加。
(9) lw rt , immediate(rs) 读存储器
100111
rs(5 位)
rt(5 位)
immediate(16 位)
功能:rt ← memory[rs + (sign-extend)immediate];immediate 符号扩展再相加。
==> 分支指令
(10)beq rs,rt,immediate
110000
rs(5 位)
rt(5 位)
immediate(位移量,16 位)
功能:if(rs=rt) pc←pc + 4 + (sign-extend)immediate <<2;
特别说明:immediate 是从 PC+4 地址开始和转移到的指令之间指令条数。immediate
符号扩展之后左移 2 位再相加。为什么要左移 2 位?由于跳转到的指令地址肯定是 4 的倍
数(每条指令占 4 个字节),最低两位是“00”,因此将 immediate 放进指令码中的时候,
是右移了 2 位的,也就是以上说的“指令之间指令条数”。
==> 停机指令
(11)halt
111111
00000000000000000000000000(26 位)
功能:停机;不改变 PC 的值,PC 保持不变。
三. 实验原理
单周期 CPU 指的是一条指令的执行在一个时钟周期内完成,然后开始下一条指令
的执行,即一条指令用一个时钟周期完成。电平从低到高变化的瞬间称为时钟上升沿,两个
相邻时钟上升沿之间的时间间隔称为一个时钟周期。时钟周期一般也称振荡周期(如果晶振
的输出没有经过分频就直接作为 CPU 的工作时钟,则时钟周期就等于振荡周期。若振荡周期经二分频后形
成时钟脉冲信号作为 CPU 的工作时钟,这样,时钟周期就是振荡周期的两倍。)
CPU 在处理指令时,一般需要经过以下几个步骤:
(1) 取指令(IF):根据程序计数器 PC 中的指令地址,从存储器中取出一条指令,同时,
PC 根据指令字长度自动递增产生下一条指令所需要的指令地址,但遇到“地址转移”指令
时,则控制器把“转移地址”送入 PC,当然得到的“地址”需要做些变换才送入 PC。
(2) 指令译码(ID):对取指令操作中得到的指令进行分析并译码,确定这条指令需要完
成的操作,从而产生相应的操作控制信号,用于驱动执行状态中的各种操作。
(3) 指令执行(EXE):根据指令译码得到的操作控制信号,具体地执行指令动作,然后
转移到结果写回状态。
(4) 存储器访问(MEM):所有需要访问存储器的操作都将在这个步骤中执行,该步骤给
出存储器的数据地址,把数据写入到存储器中数据地址所指定的存储单元或者从存储器中得
到数据地址单元中的数据。
(5) 结果写回(WB):指令执行的结果或者访问存储器中得到的数据写回相应的目的寄存
器中。
单周期 CPU,是在一个时钟周期内完成这五个阶段的处理。
图 1 单周期 CPU 指令处理过程
MIPS32 的指令的三种格式:
取指令
IF
指令译码
ID
指令执行
EXE
存储器访问
MEM
结果写回
WB
计算机组成原理与接口技术实验
R 类型:
31 26 25 21 20 16 15 11 10 6 5 0
op
rs
rt
rd
sa
func
6 位 5 位 5 位 5 位 5 位 6 位
I 类型:
31 26 25 21 20 16 15 0
op
rs
rt
immediate
6 位 5 位 5 位 16 位
J 类型:
31 26 25 0
op
address
6 位 26 位
其中,
op:为操作码;
rs:为第 1 个源操作数寄存器,寄存器地址(编号)是 00000~11111,00~1F;
rt:为第 2 个源操作数寄存器,或目的操作数寄存器,寄存器地址(同上);
rd:为目的操作数寄存器,寄存器地址(同上);
sa:为位移量(shift amt),移位指令用于指定移多少位;
func:为功能码,在寄存器类型指令中(R 类型)用来指定指令的功能;
immediate:为 16 位立即数,用作无符号的逻辑操作数、有符号的算术操作数、数据加
载(Laod)/数据保存(Store)指令的数据地址字节偏移量和分支指令中相对程序计数器
(PC)的有符号偏移量;
address:为地址。
计算机组成原理与接口技术实验
图 2 单周期 CPU 数据通路和控制线路图
图 2 是一个简单的基本上能够在单周期上完成所要求设计的指令功能的数据通路和必
要的控制线路图。其中指令和数据各存储在不同存储器中,即有指令存储器和数据存储器。
访问存储器时,先给出地址,然后由读/写信号控制(1-写,0-读。当然,也可以由时钟信
号控制,但必须在图上标出)。对于寄存器组,读操作时,先给出地址,输出端就直接输出
相应数据;而在写操作时,在 WE 使能信号为 1 时,在时钟边沿触发写入。图中控制信号
作用如表 1 所示,表 2 是 ALU 运算功能表。
表 1 控制信号的作用
控制信号名
状态“0”
状态“1”
PCWre
PC 不更改,相关指令:halt
PC 更改,相关指令:除指令 halt 外
ALUSrcB
来自寄存器堆 data2 输出,相关指
令:add、sub、or、and、move、
beq
来自 sign 或 zero 扩展的立即数,相关
指令:ori、sw、lw
ALUM2Reg
来自 ALU 运算结果的输出,相关指
令:add、sub、ori、or、and、move
来自数据存储器(Data MEM)的输
出,相关指令:lw
RegWre
无写寄存器组寄存器,相关指令:
sw、halt
寄存器组写使能,相关指令:add、
sub、ori、or、and、move、lw
InsMemRW
读指令存储器(Ins. Data),初始化为 0
写指令存储器
DataMemRW
读数据存储器,相关指令:lw
写数据存储器,相关指令:sw
ExtSel
相关指令:ori,
(zero-extend)immediate(0 扩展)
相关指令:sw、lw、beq,
(sign-extend)immediate(符号扩展)
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