ICC2timing_analysis_ug-2019.pdf_icc2如何看timing报告资源-CSDN文库

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《IC Compiler™ II 时序分析用户指南》2019版本用户指南详细介绍了S公司的IC Compiler II时序分析工具，版本为Q-2019.12，发布于2019年12月。Synopsys公司是该软件的所有者，所有的软件及文档均为其专有财产，仅在与Synopsys签订书面许可协议的条款和条件下才能使用。任何未经授权的使用、复制、修改或分发Synopsys软件或相关文档都是严格禁止的。该文档的技术数据受到美国出口管制法律的约束，读者有责任确定适用的法规并遵守。Synopsys及其许可方不提供任何形式的明示或暗示保证，包括但不限于对商品性和特定用途适用性的暗示保证。商标方面，Synopsys及其产品名称是Synopsys的注册商标，更多商标信息可在官方网站上查看。所有其他产品或公司名称可能是各自所有者的商标。关于免费和开源软件（FOSS）的许可通知，如果适用，将在产品安装中提供。此外，文档中包含的任何第三方网站链接仅供方便，Synopsys不支持也不对其负责，包括其隐私实践、可用性和内容。用户指南的内容涵盖了以下主题： 1. 关于此用户指南：这部分通常会介绍指南的目的，帮助用户了解如何有效地使用这份资料。 2. 客户支持：此处将提供Synopsys的客户支持联系方式和资源，以便用户在遇到问题时能及时获得帮助。 3. 时序分析基础：时序分析是集成电路设计中的关键步骤，用于验证电路在规定时钟周期内能否正确工作。它评估逻辑门之间的信号传播延迟，确保系统满足速度要求。 4. ICC2工具简介：详细介绍IC Compiler II的功能，它是综合优化和物理实现的旗舰级工具，用于实现高性能、低功耗的集成电路设计。 5. 时序分析流程：涵盖设置时序约束、运行时序分析、查看分析结果以及优化设计的步骤。 6. 时序报告和视图：解释如何解读时序报告，如路径延迟、时钟树分析、Slack等关键指标。 7. 时序收敛策略：提供优化设计以达到时序目标的技巧和方法。 8. 问题排查和解决：针对时序分析过程中可能出现的问题，提供解决方案和建议。 9. 高级特性：深入探讨 ICC2 的高级功能，如自适应电源网络分析、时钟树综合等。 10. 示例和案例研究：通过实例来演示如何使用IC Compiler II进行时序分析，并解释结果。《IC Compiler™ II 时序分析用户指南》是集成电路设计工程师的宝贵参考资料，它提供了全面的指导，帮助用户充分利用这款强大的工具进行有效的时序分析和设计优化。

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IC Compiler™ II Timing Analysis User

Guide

Version Q-2019.12, December 2019

Contents

About This User Guide . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8

Customer Support . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 11

1. Defining Modes, Corners, and Scenarios . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .12

Creating and Removing Modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13

Querying Modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 13

Creating and Removing Corners . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14

Querying Corners . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15

Creating a Scenario . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15

Setting the Active Analysis Types for a Scenario . . . . . . . . . . . . . . . . . . . . . . . . . . . 16

Querying Scenarios . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .17

Removing Duplicate Scenarios, Modes, and Corners . . . . . . . . . . . . . . . . . . . . . . . 18

IC Compiler II Timing Constraints . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .18

Setting Timing Constraints . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19

Converting an SDC File for IC Compiler II Timing Analysis . . . . . . . . . . . . . . . . . . . 21

Importing Timing Constraints From the Design Compiler or IC Compiler Tool . . . . . 22

Removing SDC Constraints . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 23

2. Defining Clocks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 25

Creating Real Clocks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26

Creating Virtual Clocks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26

Creating Generated Clocks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .27

Generated Clock Examples . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29

Clock Network Effects . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32

Specifying Clock Source Latency . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33

Specifying Ideal Network Latency . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .35

Specifying Clock Uncertainty . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

Specifying Clock Jitter . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .37

Contents

Specifying Ideal Clock Transition . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38

Controlling the Clock Marking Behavior . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 39

Enabling Clock-to-Data Analysis for Ideal Clocks . . . . . . . . . . . . . . . . . . . . . . . . . . .39

Unateness of Clocks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 40

Propagating a Specific Clock Sense . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .41

Creating Pulse Clocks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .42

Creating a Pulse Clock With the create_generated_clock Command . . . . . . . . 43

Defining a Pulse Clock With the set_sense Command . . . . . . . . . . . . . . . . . . . 44

Specifying the Nominal Width of a Pulse Clock . . . . . . . . . . . . . . . . . . . . . . . . . 45

Setting and Reporting Minimum Pulse Width Constraints . . . . . . . . . . . . . . . . . . . . 45

Defining the Relationship Between Clock Groups . . . . . . . . . . . . . . . . . . . . . . . . . . 46

Multiplexed Clock Exclusivity Points . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .47

Setting Clock Exclusivity Points Explicitly . . . . . . . . . . . . . . . . . . . . . . . . . . 49

Inferring Clock Exclusivity Points Automatically . . . . . . . . . . . . . . . . . . . . . .49

Reporting Exclusivity Points . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 49

Reporting Clock Information . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 50

Removing Clocks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 51

3. Constraining Timing Paths . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .52

Timing Paths and Path Groups . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .53

Creating Path Groups . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 54

Path Delay Analysis for the Same Launch and Capture Clock . . . . . . . . . . . . . . . . 55

Path Delay Analysis for Different Launch and Capture Clocks . . . . . . . . . . . . . . . . .57

Setup Analysis for Different Launch and Capture Clocks . . . . . . . . . . . . . . . . . 57

Hold Analysis for Different Launch and Capture Clocks . . . . . . . . . . . . . . . . . . 58

Introduction to Input and Output Delays . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 60

Setting Input and Output Delays for Ports . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 61

Considering the Effect of Delays Through Driving Cells . . . . . . . . . . . . . . . . . . 64

Effect of Input Delay on Clock Ports . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 64

Specifying Timing Exceptions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 65

Specifying False Path Exceptions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .66

Specifying Maximum and Minimum Path Delay Exceptions . . . . . . . . . . . . . . . . . . . 68

Specifying Multicycle Path Exceptions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 69

Specifying the Correct Number of Multicycles for Hold Analysis . . . . . . . . . . . . 71

Contents

Specifying Path Timing Margin Exceptions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .73

Specifying Exceptions Efficiently . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .75

Order of Precedence for Exceptions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .77

Precedence Based on Exception Type . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77

Precedence Based on Path Specification . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78

Example on the Order of Precedence of Exceptions . . . . . . . . . . . . . . . . . . . . . 79

Disabling Timing Paths Within Lower-Level Blocks . . . . . . . . . . . . . . . . . . . . . . . . . 79

Using Case Analysis . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 80

Disabling Timing Arcs . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 81

Enabling Preset and Clear Timing . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 82

Introduction to Data-to-Data Checks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .82

Specifying Data-to-Data Checks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 84

Examples of Data Checks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 84

Enabling Library-Based Data Checks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 86

Introduction to Clock-Gating Checks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 87

Specifying Clock-Gating Checks . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .89

4. Specifying Operating Conditions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 90

Specifying the Operating Conditions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .91

Creating and Using Scaling Groups . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 92

Creating Scaling Groups . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 92

Using Scaling Groups . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 93

Using Process Labels for PVT Matching . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 93

Reporting PVT Information . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 94

On-Chip Variation Delay Analysis . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 95

Specifying the Timing Derating Factors . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 96

Introduction to AOCV . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 98

Fast Path-Based AOCV . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 98

Setting Up for AOCV Analysis . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 98

Applying AOCV Data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .99

File-Based AOCV Data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 101

Verifying AOCV Data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .103

Introduction to Parametric On-Chip Variation Analysis . . . . . . . . . . . . . . . . . . . . . . 103

剩余160页未读，继续阅读

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内容反馈

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weixin_47825885

2022-07-13

非常有用的资源，可以直接使用，对我很有用，果断支持！
weixin_41975666

2023-06-09

这个资源值得下载，资源内容详细全面，与描述一致，受益匪浅。
AEEEO

2022-08-11

资源内容总结的很到位，内容详实，很受用，学到了~
liushenxue

2024-01-30

资源中能够借鉴的内容很多，值得学习的地方也很多，大家一起进步！
ICube1

2022-04-29

用户下载后在一定时间内未进行评价，系统默认好评。

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chan_eric

粉丝: 1
资源: 13

ICC2timing_analysis_ug-2019.pdf

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