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DDR2布线指导.ppt
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DDR2
布线指导
在现代高速数字电路的设计过程中，工
程师总是不可避免的会与DDR或者DDR2打交道
。DDR2的工作频率很高，因此，DDR的Layout
也就成为了一个十分关键的问题，很多时候
，DDR2的布线直接影响着信号完整性。下面
本文针对DDR2的Layout 问题进行讨论。
1
、
DDR2
的信号及分组
以上数据取自于
Zentel
的
A3R1GE4CFF
1
、
DDR2
的信号及分组
DDR2信号分组
1
数据信号组DQ、DQS、DM，其中每个字节又是内部的一个信
道LANE组，如DQ0~DQ7,LDQS,LDQS#,LDM为一个信号组。
2
地址和命令信号组，包括BA[],ADDR[],RAS#
,CAS#,WE#
3
控制信号组，包括CS#,CKE,ODT
4
时钟信号组，包括CK,CK#
2
、印制电路板叠层
印制电路板叠层要求
1
电路板的阻抗控制在
50~60ohm
，差分线为
100~120ohm
2
填充材料
Prepreg
厚度可变化范围是
4~6mil
3
电路板的填充材料的介电常数一般变化范围是
3.6~4.5
，它
的数值随着频率，温度等因素变化。
FR-4
就是一种典型的介电材料，在
100MHz
时的平均介电常
数为
4.2
。推荐使用
FR-4
作为
PCB
的填充材料，因为它便宜
，更低的吸湿性能，更低的电导性。
4
一般来说：
DQ
，
DQS
和时钟信号线选择
VSS
作为参考平面
，因为
VSS
比较稳定，不易受到干扰；
地址
/
命令
/
控制信号线选择
VDD
作为参考平面，因为这些信
号线本身就含有噪声。
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