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EP2C8Q208_RTL8201CL_(Dual link DVI) Hub protel硬件原理图+PCB文件+FPGA源码,硬件采用4层板设计,可用AD及PROTEL99SE 打开及编码,包括完整的原理图PCB及CYCLONE2 FPGA设计源代码,可供学习及设计参考。 2. 总体设计概述 本板作为DVI Hub控制板,主要功能是接收计算机输入的DVI数据,分三向下行输出 根据上述功能, Dual link DVI Hub电路板可以分为以下几个部分: 1. FPGA部分。主要包括一块FPGA(EP2C8QF256)和一个EPCS4、一个有源晶振20MHhz 2. DVI receiver 部分。主要包括2片panellink receiver(SII163B)including master and slave 3. DVI send 部分. 主要包括3片 (TFP410A) 4. 存储器部分:一个flash存储器(S25FL040A)和一个IIC(AT24C18) 5. DVI 传输端口部分。包括4个DVI端子, 6. 工控部分:1个温度传感器DS18B20 7. 电源部分
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EP2C8Q208_RTL8201CL_(Dual link DVI) Hubprotel硬件原理图+PCB文件+FPGA源码.zip (23个子文件)
EP2C8Q208_RTL8201CL_(Dual link DVI Hub).ddb 3.6MB
EP2C8Q208_RTL8201CL_(Dual link DVI Hub)-AD版
Documents
drive.sch 27KB
memory.sch 45KB
control.sch 6KB
VD3030.sch 12KB
FPGA.sch 573KB
TQFP64.PCBLIB 73KB
Power.sch 25KB
DVI_OUT2.sch 26KB
Documents.PrjPcb 33KB
DVI_OUT1.sch 27KB
VD3030.PCB 1.07MB
DVI_IN.sch 418KB
VD3030.NET 33KB
EP2C8Q208_RTL8201CL_(Dual link DVI Hub)BOM单.xls 36KB
FPGA(EP2C8Q208)-VERILOG逻辑源码
crmu_03.v 701B
clk_test.v 2KB
clk_lvds.v 4KB
dvi_out_02.v 10KB
dvi_hub_03.v 4KB
Led_Ctrl_SV1.v 4KB
pll.v 9KB
EP2C8Q208_RTL8201CL_(Dual link DVI Hub)电路板原理图设计说明.doc 404KB
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