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数电本科总复习2-组合逻辑电路20100527.docx

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4 组合逻辑电路

1、FPGA 是可编程逻辑器件。（

3、PAL 器件仅对逻辑宏单元OLMC 进行编程。（

4、GAL 是通用阵列逻辑器件，可以进行反复编程。（

）

6、超前进位加法器比串行进位加法器慢。

7、优先编码器的编码信号是相互排斥的，不允许多个编码信号同时有效。（

8、共阴接法发光二极管数码显示器需选用有效输出为高电平的七段显示译码器来驱动。

应为__________ ___。

路输入

路输出的逻辑部件。

3、组合逻辑电路任意时刻的输出仅仅取决于A，与电路的B 无关；而时序逻辑电路任意时刻

2 数据选择器是一种

、

的输出除与A 有关外，还与B 有关。则选项中的A 是指

6、组合电路的输出只取决于 ___________而与______________无关。

7、不仅考虑两个____________相加，而且还考虑来自__________相加的运算电路，称为全加

8、译码器输入的是___________输出的是___________。

9、一个4 选 1 的数据选择器，应具有_____个地址输入端______个数据输入端。

、比较两个一位二进制数 A 和 B,当 A=B 时输出 F=1,则F 的表达式是_________，当 A＞B 时输出Y=1,则

Y 的表达式是_________。

11、数字电路包括

12、数据选择器是一种

路输入

路输出的逻辑部件而数据分配器则是一种

;

路输入

路输出的逻辑部件。

13、PLD 器件的基本结构包括

和

两部分

。

14、时序PLA 由

15、

GAL 器件由

，

和

三部分组成。

三个主要部分组成。

，

和

个输出端分别对应七段显示器

。

16、七段显示译码器74LS47 有

17、可用作多路数据分时传输的逻辑门是

门。

18、驱动七段数码管的译码器（CC14547）有

个数据输出端。

19、一个多位的串行进位加法器，最低位的进位输入端应

。

，而时序逻辑电路中的基本逻辑单元

20、组合逻辑电路中的基本逻辑单元是

是

。

三、选择题：

1、

一个四位二进制译码器,它的输出端有(

)个.

A. 1 B. 8

C. 10 D. 16

2、以下各电路中属于组合逻辑电路有(

)

编码器 B. 译码器 C.寄存器 D.计数器

3、组合型的PLA(

)

A. 与门阵列和或门阵列均可编程

B. 与门阵列可编程, 或门阵列不可编程

C. 与门阵列不可编程, 或门阵列可编程

D、与门阵列和或门阵列均不可编程

4、下面是组合逻辑电路的是(

A. 触发器 B. 加法器

)

C.寄存器

D. 计数器

5、一块数据选择器有三个地址输入端，它的数据输入端有（

A.3 个 B.6 个 C.8 个 D.1 个

6、比较两个一位进制数A=A 和 B=B ,当 A>B 时,输出F 为 1,则 F 的表达式为(

）

)

A. F  A B

B. F  A  B

C. F  A  B

D. F  A  B

7、测得某逻辑门输入A,B 和输出F 的波形如图,则 F(A,B)的表达式是(

A. F=A·B B. F=A+B C. F  A  B D. F  AB

)

8、全加器逻辑符号如图所示，当 

B 



时和分别为(

“0” ，

)

。

“1”， “0”，

1

∑

I1

A.C 



B C

．



C.C 

S 

 S 

1 1

9 一个 64 选 1 的数据选择器有（）个选择控制信号输入端。

、

A．6

10、

数字系统与逻辑功能部件的主要区别是有没有（

存储器

控制器

加法器

译码器

B．16

C．32

D．64

）

11 设 A A 为四选一数据选择器的地址码，X

X 为数据输入为数据输出则输出与

、

～

，Y

，

X ～ X 和 A 、 A 之间的逻辑表达式为（

）。

A A X

+ A A X + A A X + A A X

A A X  A A X  A A X  A A X

A A X

 A A X  A A X  A A X

A A X  A A X  A A X  A A X

12、8 线—3 线优先编码器的输入为I —I ，当优先级别最高的I 有效时，其输出

的

Y2 • Y1 • Y0

值是（

）。

A．111

13、下列消除竞争—冒险的方法中错误的是（ D ）。

B.010

C.000

D.101

A 修改逻辑设计

C 加滤波电容

B 引入封锁脉冲

D 以上都不对

14、

当与非门输入信号的变化顺序有以下三种情况，当（ B

）时，将可能出现竞争冒险。

00→01→11→10 B

．00→01→10→11

． 00→10→11→01

四、分析设计题：

1、(简答题)试说明组合逻辑电路和时序逻辑电路的特点。

2、

(简答题)

试说明编码器和译码器的功能。

3、下图所示是一个用四位加法器构成的代码变换电路，若输入信号

是余 3BCD 码

，

E ,E ,E ,E

问：输出端

是什么代码？

S S S S

3 2 1 0

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