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Verilog语法基础讲解之参数化设计说明书.docx
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2022-06-20
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Verilog语法基础讲解之参数化设计说明书.docxVerilog语法基础讲解之参数化设计说明书.docxVerilog语法基础讲解之参数化设计说明书.docxVerilog语法基础讲解之参数化设计说明书.docxVerilog语法基础讲解之参数化设计说明书.docxVerilog语法基础讲解之参数化设计说明书.docxVerilog语法基础讲解之参数化设计说明书.docxVerilog语法基础讲解之参数化设计说明书.docxVerilog语法基础讲解之参数化设计说明书.docx
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语法基础讲解之参数化设计
在 语法中,可以实现参数化设计。所谓参数化设计,就是在一个功能模块中,
对于一个常量,其值在不同的应用场合需要设置为不同的置,则将此值在设计时使用
关键字声明,那么在上层模块例化使用该功能模块时,可以根据具体需求重新配
置该常量的值,从而实现不同应用场合对对应常量的灵活调整。
以下为使用 设计的一个控制 闪烁灯的模块代码:
系统时钟
在此设计中,定义了一个名为 的计数器,该 在输入时钟”的驱动下,每个
时钟的上升沿执行一次自加操作,当计数到达 后,计数器清零,同时 驱动状态
发生翻转。由于系统时钟为 ,即周期为 !, 每计数 次,即 !,驱动
状态翻转一次,从而可以实现控制 以 "! 为周期进行亮灭闪烁。在这个系统中,我们可以
word 完美格式
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- 幸幸有狗2022-08-19资源是宝藏资源,实用也是真的实用,感谢大佬分享~
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