• verilog的lvds输出模块

    lvds输出模块、verilog、vivado、源码

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    2024-01-22
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  • FT601的fpga测试工程

    FT601的fpga测试工程、verilog、vivado、FT601

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    2024-01-18
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  • verilog图像截图模块

    verilog图像截图模块、截图、适配、任意参数配置

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    2024-01-18
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  • 陀螺仪数据verilog滤波和排序模块

    陀螺仪数据verilog滤波和排序模块、适配常用陀螺仪、冒泡排序算法、滤波算法、fpga、verilog、vivado、quartus ll等

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    2024-01-18
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  • 陀螺仪ICM-42688-P读取模块

    陀螺仪ICM-42688-P读取模块,verilog源码、可任意配置量程、可任意配置回报率

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    2024-01-18
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  • serdes的aurora时使用

    1、serdes的aurora时使用; 2、verilog; 3、vivado; 4、上班已测试的工程,包含源代码; 5、速率可通过更改工程而改变;

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    2023-09-26
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  • rs485-uart工程

    rs485,uart、vivado、verilog、串口、可通过上位机串口软件发送数据,RS485的fpga工程可接收参数数据;

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    2023-09-26
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  • bin文件转txt文件工具

    bin文件转txt文件工具,工程使用vs2010,该工具支持任意大小文件转换

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    2022-05-21
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  • 图像缩放模块-最大支持10放缩放

    图像缩放模块-最大支持10放缩放 压缩包中包括缩放源码,仿真源码、仿真照片及照片、bin、txt装换工具,使用平台是xilinx

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    2022-05-21
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  • 图像产生模块-支持任意分辨率

    图像产生模块-支持任意分辨率,可设置输出黑、白、红、蓝、横条、竖条、左斜杆、右斜杠、灰阶、定制化的logo等,支持xilinx、intel、安路等平台; 代码使用verilog编写,

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    2022-05-21
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