Verilg

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Verilg

: tb.rar_测频_测频的verilg程序用verilog语言实现FPGA控制测频
评级：0 浏览量：36 收藏量：0 资源大小：325KB 上传时间：2022-09-20

: FPGA中使用Verilog语言实现Hanming码（行列监督码）本工程实现的是48bit数据生成 12bitECC码，外加4bit无用数据（全部置1）共64bit数据生成（hanming_gen_bc.v），以及从64bit数据中解析出48bit裸数据的代码（tb_hanming_ecc_bc.v）
评级：5 浏览量：741 收藏量：2 资源大小：857KB 上传时间：2020-07-23

: 基于Verilog-A语言的霍尔元件仿真模型的建立在霍尔集成电路及霍尔传感器设计中,霍尔元件模型的建立直接决定该设计的精度。通过对霍尔元件的深入分析,与传统的四电阻惠斯通电桥模型、基本单元数量可缩比的精确仿真模型、等效集总电阻模型等相关霍尔元件模型进行...
评级：0 浏览量：702 收藏量：2 资源大小：319KB 上传时间：2020-05-25

: CRC32 校验的verilog实现循环冗余检查(CRC)是一种数据传输检错功能，对数据进行多项式计算，并将得到的结果附在帧的后面，接收设备也执行类似的算法，以保证数据传输的正确性和完整性。若CRC校验不通过，系统重复向硬盘复制数据，陷入死循环...
评级：5 浏览量：3591 收藏量：6 资源大小：9KB 上传时间：2019-05-07

: verilog 分频器有二，三，六，十一等分频，超详细。。。。。。。。。。
评级：0 浏览量：136 收藏量：0 资源大小：90KB 上传时间：2010-05-08

: Verilog HDL主要能力下面列出的是Verilog硬件描述语言的主要能力：* 基本逻辑门，例如and、or和nand等都内置在语言中。* 用户定义原语（UDP）创建的灵活性。用户定义的原语既可以是组合逻辑原语，也可以是时序逻辑原语。...
评级：0 浏览量：214 收藏量：0 资源大小：52KB 上传时间：2020-12-09

: FPGA读取ADIS16130程序，已工程验证采用Verilog实现了ADIS16130陀螺的角速率和温度采集。已经在工程上进行了验证。
评级：0 浏览量：87 收藏量：0 资源大小：4KB 上传时间：2019-04-21

: verilog 2001标准 verilog 2001 语言标准，是数字工程师的开发参考手册，内含pli,vpi
评级：5 浏览量：520 收藏量：2 资源大小：2.48MB 上传时间：2011-12-22

: VERILOG基础夏宇闻 VERILOG 基础夏宇闻入门经典初级中级提高篇
评级：0 浏览量：63 收藏量：0 资源大小：24.16MB 上传时间：2009-11-08

: hdl_checker：重新利用现有的HDL工具以帮助编写更好的代码 HDL Checker是一种语言服务器，其中包装了VHDL / Verilg / SystemVerilog工具，旨在减少设置所需的样板代码。它支持或自定义HTTP接口；除了可以计算出混合语言依赖性，编译顺序，解释一些编译器消息并提供一些...
评级：0 浏览量：389 收藏量：1 资源大小：217KB 上传时间：2021-02-02

: 异步fifo设计verilog源代码这是一个异步FIFO的完全代码实现的modelsim工程，并附有参考论文。仅作为参考，当然其中也有很多不足，希望批评指教，相互学习。
评级：4 浏览量：300 收藏量：1 资源大小：4.6MB 上传时间：2011-07-15

: random-maze.zip_FPGA 迷宫_PS2 VGA INTERFACE _fpga游戏_maze_random 采用verilg语言并结合VGA显示、PS2接口技术、键盘输入等实现基于FPGA开发板的可选择性迷宫游戏。可以利用电脑键盘和显示器来玩这个游戏
评级：5 浏览量：120 收藏量：2 资源大小：3.22MB 上传时间：2022-09-20

: Quatus课程设计花式流水灯加入了verilg HDL 时钟分频模块，将50M赫兹脉冲分为1HZ，设备使用的是,MAX2，12管脚作为晶振时钟输入，1到8为小灯输出，低电平点亮，用户可根据自己需求更改。电路有两个194，两个160，一个04
评级：0 浏览量：168 收藏量：0 资源大小：351KB 上传时间：2020-07-03

: encryption_key_256_Ycbcr FPGA实现Ycbcr灰度化并进行图像Arnold加密。采用verilg语言实现图像Arnold置乱算法。并加入按键key来进行不同加密效果的查看与调节。
评级：0 浏览量：168 收藏量：1 资源大小：13.95MB 上传时间：2022-03-25

: fpga.rar_FPGA通信_STM32 FPGA_fpga_fpga实现fsmc_verilog FPGA verilg语言实现测频及与stm32以fsmc通信方式进行通信
评级：5 浏览量：226 收藏量：1 资源大小：4.49MB 上传时间：2022-07-14

: fpga dsp emif 挂载寄存器可直接使用 fpga dsp emif verilg 挂载寄存器可直接使用
评级：0 浏览量：62 收藏量：0 资源大小：16KB 上传时间：2022-09-02

: chaotic_1d_jarcpn_fpga_chaotic_verilog_modelsim随机数_ 一维超混沌随机数的生成verilg，还有testbench仿真激励，modelsim的仿真工程。
评级：5 浏览量：107 收藏量：3 资源大小：26KB 上传时间：2021-10-04

: yuv转化为rgb的verilog代码通过verilg实现YUV信号和RGB信号的转化，代码在任何FPGA器件上都是可以通用的。 output [7:0] r, g, b; input [8:0] ycont_bri, u_sat, v_sat; input href_pre_shp, PAL; input out_enb; input inter_en; input ...
评级：5 浏览量：1460 收藏量：5 资源大小：4KB 上传时间：2013-08-28

: 以太网VERILOG程序基于XILINX嵌入式硬核的VERILG EXAMPLE,包含TESTBENCH的MODELSIM仿真程序
评级：5 浏览量：363 收藏量：3 资源大小：60KB 上传时间：2013-02-19

: verilog-A 教程 verilg a教程，适合初学.适合模型工作者的语言，下下来看看。
评级：5 浏览量：969 收藏量：6 资源大小：265KB 上传时间：2012-06-07

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