时钟频率查询

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时钟频率查询

: PLL设计和时钟频率产生 PLL设计和时钟频率产生机理免费下载。
评级：0 浏览量：247 收藏量：0 资源大小：1.3MB 上传时间：2021-07-06

: FPGA的时钟频率同步设计引言　网络化运动控制是未来运动控制的发展趋势，随着高速加工技术的发展，对网络节点间的时间...时钟同步通常是选定一个节点时钟作为主时钟，其他节点时钟作为从时钟。主节点周期性地通过报文将主时钟时间发送给
评级：5 浏览量：517 收藏量：1 资源大小：212KB 上传时间：2021-01-19

: 如何测量时钟频率 作为VHDL模拟器，本课程将使用ModelSim，它是VHDL/Verilog最强大的模拟器之一。ModelSim许可证非常昂贵，但您可以合法地获得免费许可证，接下来我将展示如何。作为布局工具，我们将使用Altera Quartus II。...
评级：0 浏览量：436 收藏量：0 资源大小：930KB 上传时间：2021-07-07

: 芯片时钟频率 电脑中有许许多多的半导体芯片，每个芯片都是在特定的时钟频率下进行工作的。时钟发生器提供给芯片的时钟信号是一个连续的脉冲信号，而脉冲就相当于芯片的脉搏，每一次脉冲到来，芯片内的晶体管就改变一次状态，让...
评级：0 浏览量：507 收藏量：2 资源大小：354KB 上传时间：2012-09-13

: 时钟与频率合成基本原理时钟和频率合成的应用领域 ► 锁相环(PLL)的设计与应用 ► 直接数字频率合成(DDS)的设计与应用 ► 数据转换器时钟的问题 ► 时钟产生与分配
评级：0 浏览量：378 收藏量：0 资源大小：4.19MB 上传时间：2018-09-06

: 基于FPGA的时钟频率同步设计基于时钟频率调整的时间同步方法，实现简单，而且没有复杂的软件同步协议，占用较小的网络带宽就可以实现高精度的时钟同步，在硬件上只需要低成本的FPGA支持。
评级：0 浏览量：484 收藏量：0 资源大小：318KB 上传时间：2020-08-07

: Android获取设备CPU核数、时钟频率以及内存大小的方法主要介绍了Android获取设备CPU核数、时钟频率以及内存大小的方法,涉及Android针对系统硬件相关操作技巧,需要的朋友可以参考下
评级：0 浏览量：2406 收藏量：0 资源大小：59KB 上传时间：2020-09-01

: VxWorks内核时钟频率的修改1 他启用的是与系统时钟不同的硬件定时器，挂接用户自己的中断处理函数，去掉用户自己的中断处理函数，去掉内核驱动的负荷，时钟分辨率的高低取决于硬件定时器的精度和用户中
评级：0 浏览量：68 收藏量：0 资源大小：364KB 上传时间：2022-08-03

: MIPI的高速时钟频率与显示屏分辨率及帧率之间的计算关系 MIPI高速时钟频率与驱动的LCD屏幕分辨率及刷新率之间的换算关系
评级：0 浏览量：9170 收藏量：10 资源大小：17KB 上传时间：2018-07-10

: RTL代码检测时钟频率 用于检测时钟频率，用一个基准50MHz时钟检测其他时钟，结果频率用10进制表示
评级：0 浏览量：342 收藏量：1 资源大小：2KB 上传时间：2018-09-22

: 时钟频率检测模块verilog程序 时钟频率检测模块，可用于检测时钟频率。
评级：0 浏览量：50 收藏量：0 资源大小：2KB 上传时间：2024-01-25

: Atmel推出时钟频率高达2GSps的ADC模块新模块采用最新的10位ADC，可提供时钟频率达2Gsps，具有一个嵌入式1:4 LVDS多路信号分离器，直接接口标准FPGA。新发布的AT84AS004TP与Atmel之前发布的AT84AS003TP 10位1.5Gsps ADC和DMUX完全兼容。它采用与...
评级：0 浏览量：131 收藏量：0 资源大小：54KB 上传时间：2020-12-01

: 基于时钟频率调整的时间同步的FPGA实现及应用本文研究了一种可对频率进行动态调整的时钟，通过对时钟频率的动态修正，实现主从时钟频率的同步，进而实现时间同步。
评级：0 浏览量：393 收藏量：0 资源大小：129KB 上传时间：2020-07-30

: Atmel推出时钟频率高达2.2Gsps的ADC Atmel公司日前推出业界最快速的商用10位ADC AT84AS008GL，时钟频率达2.2Gsps。基于2.2GHz的采样率，AT84AS008GL模数据转换器在引脚上与TS83102G0BGL完全兼容，可无缝升级并提供第一Nyquist区中1.7Gsps的8位有效...
评级：0 浏览量：137 收藏量：0 资源大小：36KB 上传时间：2020-12-01

: 为什么CPU时钟频率在过去5年里没有增加？ CPU时钟频率在过去5年里没有增加是很多不同类别的原因导致的。当设计一个CPU的微架构时，其中一个关键的设计决策就是如何实现更高的性能。在奔腾4时代，英特尔选择了具有非常高的时钟频率和相对较窄的管道。这种方法...
评级：0 浏览量：273 收藏量：0 资源大小：90KB 上传时间：2020-08-04

: STM32ZET6外部时钟触发测频率基于STM32F103ZET6的外部时钟触发测频率，理论可达35-36M，采用正点原子的TFTLCD屏幕显示。
评级：5 浏览量：677 收藏量：5 资源大小：3.58MB 上传时间：2020-09-30

: 频率计加时钟程序频率计和电子钟（仿真+程序）。51单片机，1602显示，1302电子钟芯片，按键调时，具有测频功能。
评级：0 浏览量：46 收藏量：0 资源大小：19KB 上传时间：2013-08-30

: 测量较低时钟频率的相位噪声和相位抖动资料下载本期我将讨论在测量较低时钟频率的相位噪声和相位抖动时出现的一个非常常见的问题。在所有条件相同的情况下，我们通常期望分频的低频时钟产生比高频时钟更低的相位噪声。在数量上，你可能会记得这是20log（N）规则。...
评级：0 浏览量：74 收藏量：0 资源大小：425KB 上传时间：2021-07-07

: 数字电路调试中时钟问题的分析与处理针对数字电路调试中时钟的问题,分析比较了各种电路的现象,通过反复调试,提出了正确选择时钟频率的处理方法。通过对有关数字电路时钟问题的深入了解,可供使用者借鉴,具有很好的参考价值。
评级：0 浏览量：388 收藏量：0 资源大小：176KB 上传时间：2020-07-13

: 通信与网络中的TI新型LVDS收发器支持消费类应用时钟频率 日前，德州仪器(TI)宣布推出一款14位低电压差分信号(LVDS)串行器/解串器(SERDES)——SN75LVDT1422，从而显著节约...该串行器可接受14条晶体管－晶体管逻辑(TTL)输入线路，并可生成两组LVDS高速串行流以及一组LVDS时钟信
评级：0 浏览量：154 收藏量：0 资源大小：58KB 上传时间：2020-11-29

: 智能卡时钟频率转换因子表智能卡复位信息中时钟频率转换因子查询表
评级：0 浏览量：115 收藏量：0 资源大小：16KB 上传时间：2020-12-31

: DDR时钟频率测试软件本软件带使用说明，可以测试DDR内存的实时频率
评级：0 浏览量：431 收藏量：0 资源大小：136KB 上传时间：2013-01-30

: IIS音频时钟与传输方式串行时钟频率IISCLK可以为采样频率的16、32、48倍。　表1 音频主时钟与采样频率的对应关系　IIS总线的传输方式一般有三种：正常传输模式、DMA传输模式及发送和接收模式。　（1）正常传输模式。IIS控制寄存器有...
评级：0 浏览量：1083 收藏量：0 资源大小：84KB 上传时间：2020-11-12

: 微型高稳定锁相时钟频率源本文介绍用集成电路MAX2620和集总LC元件构成窄带VCO电路模块，然后同集成锁相频率合成器芯片MB1504一起构成锁相环式低噪声、高稳定性的锁相频率源电路的设计方法。
评级：0 浏览量：83 收藏量：0 资源大小：191KB 上传时间：2020-10-24

: EDA/PLD中的FPGA的时钟频率同步设计引言　网络化运动控制是未来运动控制的发展趋势，随着高速加工技术的发展，对网络节点间的时间...时钟同步通常是选定一个节点时钟作为主时钟，其他节点时钟作为从时钟。主节点周期性地通过报文将主时钟时间发送给
评级：0 浏览量：124 收藏量：0 资源大小：166KB 上传时间：2020-11-08

: VHDL_clock.zip_VHDL时钟_时钟状态机vhdl_频率控制运用VHDL写的时钟控制程序，状态机，时钟分频，频率变换。
评级：0 浏览量：67 收藏量：0 资源大小：11.61MB 上传时间：2022-07-14

: gpu_freqlib:轻量级的C ++库，可在NVIDIA GPU上改变内核和内存时钟频率 轻量级的C ++库，用于在NVIDIA GPU上改变内核和内存时钟频率。先决条件支持内核和内存时钟频率调整的NVIDIA GPU CUDA工具包6.5或更高版本 NVIDIA GDK（用于NVML）（）安装 gpu_freqlib是仅标头的C ++库。因此...
评级：0 浏览量：195 收藏量：0 资源大小：5KB 上传时间：2021-04-27

: AIP8563时钟芯片中文资料 6. 可编程时钟输出频率为：32.768KHz，1024Hz，32Hz，1Hz 7. 报警和定时器 8. 掉电检测器 9. 内部集成的振荡器电容 10. 片内电源复位功能 11. I2C总线从地址：读，0A3H；写，0A2H 12. 开漏中断引脚 13. 封装形式：...
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: 关于STM32F407启动后的系统时钟频率问题 "STM32F407启动后的系统时钟频率问题" 在STM32F407中，系统时钟频率的问题是一个经常被忽视的问题。我们通常认为，系统时钟频率是在SystemInit函数中设置的，但是实际上，这并不是事实。在本文中，我们将通过实验和...
评级：0 浏览量：1235 收藏量：1 资源大小：185KB 上传时间：2018-12-26

: 基于FPGA的时钟频率同步设计与应用文研究了一种可对频率进行动态调整的时钟，通过对时钟频率的动态修正，实现主从时钟频率的同步，进而实现时间同步。
评级：0 浏览量：165 收藏量：0 资源大小：586KB 上传时间：2020-10-20

: 时钟单元基本结构 TMS320F28l2处理器内部集成了振荡器、锁相环、看门狗及工作模式选择等控制电路。...处理器还将集成的外设分成高速和低速两组，可以方便地设置不同模块的工作频率，从而提高处理器的灵活性和可靠性。　欢迎
评级：0 浏览量：172 收藏量：0 资源大小：97KB 上传时间：2020-11-13

: 数字时钟管理器 DCM的功能包括消除时钟的延时、频率的合成及时钟相位的调整等系统方面的需求。　由于DOM把高性能的时钟直接整合到FPGA全局时钟分配网络，因此DCM解决了很多常见的时钟问题。特别是在高频及高性能的应用中，使用DCM...
评级：0 浏览量：224 收藏量：0 资源大小：107KB 上传时间：2020-11-17

: 01_rtc_ds1302_AX301实时时钟_ 实现基于黑金开发板的实时时钟功能，显示时分秒
评级：5 浏览量：194 收藏量：1 资源大小：3.86MB 上传时间：2021-09-30

: 单片机时钟电路原理.doc 在外部时钟方式中，XTAL1 引脚接地，XTAL2 脚接外部时钟，对于外部时钟信号并无特殊要求，只要保证一定的脉冲宽度，时钟频率低于 12MHz 即可。这种方式下，时钟电路的振荡信号来自外部时钟信号。单片机的时钟信号 ...
评级：0 浏览量：212 收藏量：0 资源大小：13KB 上传时间：2022-12-16

: 时钟频率和二级缓存大小对CPU效率的影响.pdf 时钟频率和二级缓存大小对CPU效率的影响.pdf
评级：0 浏览量：60 收藏量：0 资源大小：116KB 上传时间：2021-09-24

: STM32 通过外部时钟输入模式测量频率，串口打印使用了stm32f103zet6 通过外部时钟输入模式进行频率采集，在100khz以上误差在10hz左右
评级：4 浏览量：681 收藏量：5 资源大小：3.13MB 上传时间：2017-10-08

: Verilog设计-时钟分频 Verilog设计_时钟分频时钟分频的设计，实现任意的奇数分频和偶数分频。分频的本质是引入一个计数器，到特定的时候指示反转，从而达到分频的效果。通过控制计数器的动作进而控制占空比，但是奇数分频想通过计数器...
评级：5 浏览量：701 收藏量：1 资源大小：2KB 上传时间：2023-04-24

: 乘法器时序约束提高时钟频率.one 乘法器时序约束提高时钟频率.one
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: PLL_test.rar_FPGA 锁相环_PLL_pll_test.v_时钟频率_锁相环用FPGA实现锁相环分频，将基准时钟频率通过PLL核分频生成多种时钟生成。
评级：0 浏览量：97 收藏量：0 资源大小：230KB 上传时间：2022-09-23

: 小技巧之简单验证K60内部时钟运行频率新的一年，开个好头~K60凉在手里好多天了，好久没弄了，今天又拿出来当宝贝似的玩了玩，捣鼓了一上午，有点小收获，跟大家分享一下，因为只是一种小技巧，所以就不单独列入从零入手系列了。
评级：0 浏览量：151 收藏量：0 资源大小：65KB 上传时间：2020-08-05

: Linux内核时钟.doc 首先，时钟模块需要提供系统时间和频率 references，这可以通过读取系统的时钟寄存器来实现。其次，时钟模块需要控制系统的执行顺序和进度，这可以通过调度器来实现。最后，时钟模块需要与其他内核模块进行交互，...
评级：0 浏览量：117 收藏量：0 资源大小：993KB 上传时间：2021-01-17

: yjh_数字时钟_ （1）设计一个 12/24 小时制数时钟；（2）利用板上数码管显示时、分、秒；（3）利用板上按键实现时钟调整...整点报时声频率应与其他报时声频率有明显区别；（8）具有按 12 小时模式显示与 24 小时模式显示切换的功能。
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: DSP中的可提供300MHz时钟频率的I/Q调制发生器近日，Rohde & Schwarz推出R&S AFQ100A I/Q调制发生器，可提供存储...该产品具有1kHz至300MHz宽范围的内存时钟频率，及1Gsample的存储深度，可产生高达200MHz的RF频段I/Q信号，因而也支持未来宽度通信系统的需要。　R
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: XS128设置时钟频率为40MHz XS128设置时钟频率为40MHz，可以修改里面的参数，改为其他的频率！亲测可用
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: Android数码管时钟只是提供了如歌调用外部字体的思路，欢迎参考！
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: 用输入时钟调节数字斜波发生器的频率然而，图中的数字斜波发生器电路可以只通过在100Hz到约6MHz之间更改输入时钟来使斜波频率在小于1Hz到约30kHz之间变化。测得输出端电压的峰值为5V，但它也可用通过改变R1和R6来进行调节。要确保驱动DAC08 8位高速的...
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: 数字时钟（数字逻辑）数字逻辑课程设计-数字时钟课程设计的三个简单要求 1、设计一个能显示日期、小时、分钟、秒的数字电子钟，并具有整点报时的功能。 2、由电路产生1HZ标准的信号。分、秒为六十进制计数器，时为二十四进制计数器。 3...
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