Veri

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: 车辆Re-ID数据集（分角度）_veri-wild, veri-776数据集不同方向成对图像拼接（保持车ID不变），可作一般用途，可作为数据增强数据集，生成不同角度的图像，利用GAN网络
评级：5 浏览量：1596 收藏量：1 资源大小：104.75MB 上传时间：2022-07-01

: Veri-Tabani 韦里塔巴尼
评级：0 浏览量：445 收藏量：0 资源大小：289KB 上传时间：2021-03-29

: VeRi.zip(Vehicles识别数据集) VeRi.zip(Vehicles识别数据集)
评级：0 浏览量：2443 收藏量：7 资源大小：945.51MB 上传时间：2022-01-12

: VeRidataset:这是Veri数据集的项目页面，该数据集是用于城市交通监控中车辆重新识别的大规模图像数据集 1. VeRi数据集（请单击进入新网页。）为了促进对车辆重新识别（Re-Id）的研究，我们在现实世界的城市监视场景中为车辆Re-Id建立了一个大型基准日期集，称为“ VeRi”。 VeRi的特色属性包括：它包含24个摄像头在...
评级：0 浏览量：890 收藏量：2 资源大小：489KB 上传时间：2021-05-11

: dmhs-V4.1.48-pack4-dm8-rev104804-rh6-64-veri-20211228 达梦DMHS测试体验版本，只供测试、技术学习、探究，不能用于生产。DMHS版本与达梦8版本需要一一对应。该版本时间为20211228，则达梦8版本也应对应20211228时间左右的版本。
评级：0 浏览量：38 收藏量：1 资源大小：480.06MB 上传时间：2023-10-24

: ECD-Veri ECD-Veri
评级：0 浏览量：54 收藏量：0 资源大小：956KB 上传时间：2021-03-09

: Veri_Yapilari Veri_Yapilari
评级：0 浏览量：51 收藏量：0 资源大小：419.36MB 上传时间：2021-02-26

: VeRi：大规模城市交通监控车辆重识别图像数据集为了促进车辆重识别（Re-Id）的研究，我们在现实世界城市监控场景中建立了一个名为“VeRi”的车辆Re-Id的大规模基准数据集。 VeRi的特色包括：它包含超过50,000张776辆车的图像，这些图像由20台摄像机拍摄，在24...
评级：3 浏览量：1622 收藏量：4 资源大小：847.15MB 上传时间：2021-06-25

: VeRi-776数据集车辆重识别公用VeRi-776数据集，供大家学习使用
评级：0 浏览量：1022 收藏量：2 资源大小：945.51MB 上传时间：2023-04-10

: matlab终止以下代码-vehicle-triplet:用于Veri776和VehicleID的三重模型火车 matlab终止以下代码基于三元组的人员重新识别重现我们的“为重新识别人的三元组损失辩护”论文结果的代码。我们提供以下内容：本文使用的TriNet模型的确切预训练权重，包括一些用于使用它计算嵌入的基本示例代码...
评级：0 浏览量：156 收藏量：0 资源大小：232KB 上传时间：2021-05-21

: Veri sBacku E ec产品.pdf Veri sBacku E ec产品.pdf
评级：0 浏览量：11 收藏量：0 资源大小：628KB 上传时间：2023-11-05

: Veri-Bilimi-Patikasi Veri-Bilimi-Patikasi-
评级：0 浏览量：46 收藏量：0 资源大小：1KB 上传时间：2021-03-27

: adder8_makefile_veri_verilog_slow7rj_VCS_ 这个实例是一个加法器的实现。包括VCS和Makefile文件的编写。
评级：0 浏览量：77 收藏量：0 资源大小：1KB 上传时间：2021-10-02

: 正弦信号的matlab代码-VERI:使用Verilog的配置FPGA，2018年 VERI第1部分 .bsf和.bdf 我们发现.bsf和.bdf之间的链接是双向的，我们可以仅包含.bsf或.bdf，并且代码仍将“分析和阐述”。但是UTA建议我们包含.bdf，因为通常这样做是这样。 SLOW 0和85摄氏度传播延迟之间有什么...
评级：0 浏览量：124 收藏量：0 资源大小：246.83MB 上传时间：2021-05-21

: veri_adder.rar_adders_verilog codes verilog VHDL codes for adders
评级：0 浏览量：27 收藏量：0 资源大小：174KB 上传时间：2022-09-22

: veri_ports:Verilog编辑自动化（主要是创建实例化模板，端口列表等） veri_ports Verilog编辑自动化（主要是创建实例化模板，端口列表等）如何使用：将模块实例化Verilog代码或端口声明代码复制到文本窗口。现在，您可以使用“ inst。-> ports”和“ ports-> inst”在它们之间相互...
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: VeriBilimi:Veri Bilimi-3 DersNotları YBS407：Veri Bilimi-3 YBS407：Veri Bilimi-3 @İstinyeUniversitesi（GüzDönemi）
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: Türkçe Sosyal Medya PaylaşımıVeri Seti数据集.zip 自然语言处理数据集
评级：0 浏览量：7 收藏量：0 资源大小：352KB 上传时间：2024-02-14

: Proje-1-Temel-Veri-Analizi Proje-1-Temel-Veri-Analizi
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: VERI CUT7.2.1许可证 VERI CUT7.2.1许可证，已修改好，可用到2018年
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: veri-yapilari-ve-algoritmalar:计算机科学爱好者的数据结构和算法指南算法和数据结构指南它是数据结构和算法主题的指南，这些主题在计算机科学中具有非常重要的作用，每个软件开发人员都应该学习。
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: titanic_ml_project:Veri bilimi泰坦尼克号 titanic_ml_project:Veri bilimi泰坦尼克号
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: Pamuk Alışveriş Habercisi-crx插件语言:Türkçe cotton.co购物信使提供有关购物网站上提供的产品和品牌的日常活动和折扣信息。 ... Pamuk.co购物信使您的互联网浏览您通过制定新产品，折扣，广告系列和购物世界的正常新闻，您将直接收到通知，使您的...
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: Alışveriş Asistanı-crx插件语言:Türkçe 帮助您找到您在购物中寻找的最便宜的价格网上购物网站是一个加载项，可帮助您找到我在线购物网站的最便宜的替代品。通过这种方式，您将允许您在您的购物和价格研究中节省时间和金钱，您将能够更快地...
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: fifo.zip_Makefile linux_fifo_synopsys vcs_synopsys verilog_veri 基于verilog HDL的fifo设计与测试，包含设计与测试代码，以及简单的makefile编写。整个平台是基于linux操作，仿真平台是基于SYNOPSYS的vcs工具。
评级：0 浏览量：79 收藏量：0 资源大小：15KB 上传时间：2022-09-23

: code_lagrange_interpolation.zip_interpolation vhdl_lagrange veri 使用verilog实现拉格朗日插值，很有使用价值，有需要的可以参考一下
评级：0 浏览量：46 收藏量：0 资源大小：8KB 上传时间：2022-07-14

: UART.rar_QUARTUS II UART_modelsim_quartus uart_uart verilog_veri 语言：verilog语言功能：通过串口控制模块，实现FPGA与串口通信。仿真环境：modelsim 综合环境：quartus II
评级：5 浏览量：88 收藏量：0 资源大小：63KB 上传时间：2022-09-19

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: alu.rar_RISC verilog_alu verilog_mcu verilog_verilog cpu 代码_veri mcu，risc cpu Verilog源代码
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: temper_test.zip_MAX7219 VERILOG_Nixie tube_max7219 verilog_veri 通过Verilog实现用DS18B20温度传感器用MAX7219驱动8个数码管显示。（MAX7219驱动程序也在里面）。实验用EP4CE22F17芯片实现。
评级：0 浏览量：101 收藏量：0 资源大小：4.04MB 上传时间：2022-09-15

: lcd.rar_FPGA verilog_fpga lcd_lcd verilog_lcd1602 verilog_veri FPGA控制lcd1602(verilog)
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: eetop.cn_FIFO_Buffer.rar_buffer verilog_fifo verilog_fpga_veri 异步FIFO的Verilog程序及其测试程序
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: AD9639_Quartus.zip_AD9369_VERILOG adc_fpga adc_troubleusr_veri ADI AD9369 4路高速ADC的FPGA接口，包含Altera Quartus工程和Verilog源代码
评级：5 浏览量：82 收藏量：0 资源大小：582KB 上传时间：2022-07-15

: apb.rar_APB Verilog code_Apb_apb verilog_apb verilog_apb协议 veri Verilog code for APB Protocol
评级：5 浏览量：173 收藏量：0 资源大小：1KB 上传时间：2022-07-14

: dpll_demo.rar_Verilog code for PLL_dpll vhdl co_verilog 锁相环_veri 一个实现简单的数字锁相环Verilog代码，本人借鉴网上现有的代码后经修改在Cyclone II上调通实现，里面有ModelSim仿真成功的波形图
评级：5 浏览量：61 收藏量：1 资源大小：66KB 上传时间：2022-07-13

: Verilog_HDL.rar_Verilog_HDL_hdl_verilog hdl入门_verilog 华为_华为 veri Verilog_HDL_华为入门教程，非常适合于入门学习
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: DDS.zip_FPGA DDS_dds verilog_fpga dds verilog_fpga中dds使用_ip veri FPGA产生DDS，未使用IP核，内含VERILOG程序
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: fft.rar_Verilog FFT_Verilog实现FFT_fft的FPGA verilog_fpga的fft_veri 用Verilog语言实现 fpga 上的 fft功能
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: adc_spi.rar_SPI ADC verilog_adc spi_delta sigma ADC_dsp adc_veri dsp通过SPI接口数据采集 sigma-delta ADC采集程序
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: xml-to-yolo:XmlFormatındaEtiketli Veri Setini YoloFormatınaÇevirme xml到yolo XmlFormatındaEtiketli Veri Setini YoloFormatınaÇevirme 库兰尼米： git clone cd xml-to-yolo python xml-to-yolo.py
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