BCD码减法

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BCD码减法

: BCD码减法实现程序 BCD码减法实现程序，非常完整，采用Verilog HDL语言实现。-BCD subtraction to achieve program code, very complete, using Verilog HDL language.
评级：1 浏览量：2078 收藏量：4 资源大小：49KB 上传时间：2011-07-04

: 多字节BCD码减法汇编语言程序入口条件：字节数在R7中，被减数在[R0]中，减数在[R1]中。出口信息：差在[R0]中，最高位借位在CY中。
评级：0 浏览量：507 收藏量：0 资源大小：18KB 上传时间：2020-08-25

: BCD码减法程序led数码管显示将两个多位十进制数相加，要求被加数，加数均以ASCII码形式按顺序存放在以DATA1和DATA2为首的5个内存单元中（低位在前），结果送回RESULT处，并在数码管中显示。
评级：0 浏览量：282 收藏量：0 资源大小：3KB 上传时间：2012-12-05

: BCD码加法程序自己写的BCD加法计算程序，供大家交流学习，版权归大家
评级：0 浏览量：1155 收藏量：2 资源大小：909B 上传时间：2013-05-16

: 用VHDL编写的一位BCD码的加减法用VHDL语言编写的关于一位BCD码的加减法的程序
评级：0 浏览量：324 收藏量：0 资源大小：24KB 上传时间：2010-01-11

: 单片机与DSP中的单片机多字节ＢＣＤ码加法减法（１）标号：ＢＣＤＡ功能：多字节ＢＣＤ码加法入口条件：字节数在R7中，被加数在[R0]中，加数在[R1]中。出口信息：和在[R0]中，最高位进位在CY中。影响资源：PSW、A、R2 堆栈需求：２字节BCDA: MOV A,R7 ；取...
评级：0 浏览量：508 收藏量：0 资源大小：32KB 上传时间：2020-12-13

: BCD码的运算法则 BCD码的运算规则，很实用的资料，对于编程有重要的知道意义。
评级：0 浏览量：750 收藏量：0 资源大小：56KB 上传时间：2013-03-17

: 2位BCD码的可控加减法器.circ 2位BCD码可控加减法器，在4位先行进位加法器的基础上进行设计，文件内包含多个子电路及其封装，采用16进制数码管显示输入输出，结合三态门实现负号。需要使用logisim软件打开。
评级：0 浏览量：329 收藏量：0 资源大小：167KB 上传时间：2022-11-05

: 基于Multisim的8位二进制转BCD码仿真 74185是用途很广的芯片，它可以将二进制数转换成十进制BCD码。但是，无论Multism还是Proteus，均没有74185的仿真模型。作者参考74185的Datasheet，利用分立元件制作了74185仿真电路，可将8位二进制数转换十进制BCD...
评级：5 浏览量：1951 收藏量：6 资源大小：730KB 上传时间：2022-04-23

: verilog HDL 高效二进制转bcd码程序(下载请看软件说明) 占用资源少、移植性好、扩展方便的verilog HDL二进制转bcd码程序下载的朋友请在 bcd ; 的前面加上 result[0] = bin[B_SIZE-1]; 由此造成的不便请见谅 CSDN文档上传后不能删除，这点也让我纠结
评级：5 浏览量：176 收藏量：0 资源大小：1KB 上传时间：2010-11-20

: 模为60的BCD码加法计数器FPGA设计Verilog逻辑源码Quartus工程文件.zip 模为60的BCD码加法计数器FPGA设计Verilog逻辑源码Quartus工程文件， Quartus软件版本11.0, FPGA型号为CYCLONE4E系列中的EP4CE6E22C8,可以做为你的学习设计参考。 module cnt_60(clk,reset,cin,load,data,cout,qout)...
评级：5 浏览量：2422 收藏量：7 资源大小：142KB 上传时间：2021-08-23

: 4位BCD码加法器的设计 ALU的设计与仿真—4位BCD码加法器的设计本次的设计内容是ALU的设计与仿真—4位BCD码加法器的设计。
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: bcd码大数计算源码 bcd大数计算源码（vb）加法减法乘法除法
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: 用T触发器构成的同步2进制减法计数器实验电路multisim源文件用T触发器构成的同步2进制减法计数器实验电路multisim源文件，multisim10及以上版本可以正常打开仿真，是教材上的电路，可以直接仿真，方便大家学习。
评级：5 浏览量：1676 收藏量：0 资源大小：88KB 上传时间：2020-11-26

: 微机原理（4位BCD码相加）微机原理（4位BCD码相加）微机原理（4位BCD码相加）微机原理（4位BCD码相加）微机原理（4位BCD码相加）
评级：0 浏览量：429 收藏量：2 资源大小：2KB 上传时间：2010-05-13

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: 8421 BCD 计数器 VHDL （0-9） 8421 BCD 计数器 VHDL （0-9） qt2 测试通过
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: bcd.rar_bcd加法_字节数R7_字节数入口功能：多字节ＢＣＤ码加法和减法入口条件：字节数在R7中，被加数在[R0]中，加数在[R1]中。出口信息：和在[R0]中，最高位进位在CY中。影响资源：PSW、A、R2 堆栈需求：２字节
评级：0 浏览量：55 收藏量：0 资源大小：3KB 上传时间：2022-09-20

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评级：5 浏览量：1032 收藏量：0 资源大小：121KB 上传时间：2022-07-05

: 704H减44H等于660H，用51的汇编语言怎么写？这个题目用51单片机的汇编语言来做，实际上是进行两个字节的BCD码的减法。
评级：0 浏览量：80 收藏量：0 资源大小：26KB 上传时间：2020-07-25

: 汇编实验报告(1).doc 4）写程序把从键盘输入的四位十六进制数转换为压缩的BCD码，并显示输出。 5）编写一通用过程用来将十进制数(从键盘输入)转换为P(从键盘输入)进制数。三、实验设备 PC机一台四、实验步骤 1) 按程序流程图编制实验...
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: 汇编语言编码非BCD码的编程，利用非BCD码进行减法运算：5621-4203并输出结果
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: 数字电路课设-自动循环计数器电路multisim仿真源文件+文档说明.zip 数字电路课设-自动循环计数器电路multisim仿真源文件+文档说明: 一、设计目的 1、熟练掌握计数器的应用。 2、加深对加减循环计数和显示电路的... 3、计数部分：完成BCD码3~9的可逆加或减循环计数。系统方框图如下：
评级：5 浏览量：552 收藏量：5 资源大小：722KB 上传时间：2022-12-24

: 数字电子产品设计与制作：N进制计数器的设计.pptx 利用集成四位二进制同步计数器和8421BCD码十进制计数器是功能较完善的计数器，用它可组成任意进制的计数器，组成的方法有两种，一种方法叫反馈归零法，也叫复位法，另一种方法叫置位法。 1.复位法所谓复位法，...
评级：0 浏览量：305 收藏量：0 资源大小：562KB 上传时间：2022-07-03

: 计算机组成原理作业.docx 一位十进制数，用BCD码表示需___ 4 ___位二进制数表示。 8．给定一个8K*4bit的芯片，如果组成32Kx8bit的存储体，需要该芯片 8 个。 9．-85的补码表示为。 10. ASCII码67H采用的是偶校验，那么校验位为 1 。三．...
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评级：0 浏览量：240 收藏量：2 资源大小：105KB 上传时间：2023-05-25

: 数电课设作业：10进制计数器电路图源文件分享 -电路方案有了计数编码输出之后，我们就要进行编码了，我们采用CD4511这样一个译码芯片，它是一个七段码译码器，具有BCD转换，消隐和锁存控制、七段译码及驱动功能的CMOS电路能提供较大的拉电流，可直接驱动共阴LED数码管。...
评级：5 浏览量：1166 收藏量：2 资源大小：1.01MB 上传时间：2021-04-20

: 杭州电子科技大学学生考试卷（A）卷数字电路与硬件描述语言 1. （25.5）2 ＝（0010 0101.0101）BCD8421 ＝（0101 1000.1000）余 3 码 2. （73）10 ＝ ( 1101101 )格雷码； 3. ＝（ A+B ），＝（ A ）； 4. 4位二进制减法计数器的初始状态为Q3Q2Q1Q0＝0100，经过7个有效...
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: 大工21秋《计算机原理》在线作业1-【答案】.doc 某数在计算机中用8421BCD码表示为011110001001，其真值为（）。【A.】789 【B.】3611 【C.】1929 【D.】11110001001B 【本题-标准-答案】：A 5.下列选项中,()不属于硬件。【A.】CPU 【B.】ASCII 【C.】内存【D.】...
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: 东大22春《计算机硬件技术基础》在线平时作业3-00001 1.4.使用DOS 功能调用时，子程序编号应放在__寄存器中。2.3.计算机系统中的存储器系统是...17.1.十进制数10的8421BCD码为1010。18.1.三态门的输出有三个状态：0态、1态和高阻态。19.1.8086和8088的数据总路线都是16位。
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: 大工19春《计算机原理》在线作业123参考答案.docx 移正确答案:B 某数在计算机中用8421BCD码表示为1010,其真值为()。 A.2 B.8 C.9 D.10 正确答案:D ()常用来比较两个数是否相等。 A.与 B.或 C.非 D.异或正确答案:D 早期的计算机术语中,把控制器和()合在一起称为中央...
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评级：0 浏览量：47 收藏量：0 资源大小：113KB 上传时间：2021-04-08

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: PLC-电子计算器设计.doc 此过程需要使用中间继电器以及@MOV、+BC、- BC、*B、/B函数（对BCD码进行加减乘除运算）；为了节省I/O资源，可以采用SDEC函数。当执行条件为ON时，根据其控制字C的内容，对S进行译码，并将结果放入指定的通道 R中...
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: 天津大学2014数字逻辑期末考试及答案.rar BCD 码 4 ．对于如图所示波形，其反映的逻辑关系是＿ B : AB c 一门日门 l 日几一 A ．与关系 B ．异或关系 C ．同或关系 0 ．无注判断彼字逻扭电路 3 卷替案策 l 灭共 8 贬口口口口口口口口口口口口口口口口口口口...
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: 基于Quartus II 9.0版本编写的Verilog HDL编写的基本设计实例包含8位奇偶校验器、16选一数据选择器、add、add4、八位二进制加法计数器、利用function函数对一个8位二进制数中为0的个数计数、模为60的BCD码同步加法计数器、减法计数器、分频器、数字跑表、抢答器等等代码。...
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: PIC单片机子程序集该子程序包含了PIC单片机的各种常用子程序。如BCD码加减法、转换、RS232串口、I2C程序等等
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: HT MCU 加、减、乘、除法本程序包含八位、十六位、二十四位及三十二位定点数据的基本运算。基本的运算包括：加法（有符号、无符号）、减法（有符号、...符号）、除法（有符号、无符号）、BCD 码的加、减法、BCD 码与二进制码的相互转换等等。
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