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quartus2 基于原理图方式构建频率计
quartus2 基于原理图方式构建频率计
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quartus2 基于原理图方式构建频率计
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数电实验报告QuartusII原理图输入法设计与实现.pdf
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quartus 2 频率计设计
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用VHDL语言实现频率计的课程设计 可用MAXLLUS或quartus实现
QUARTUS基于cylone二的数字频率计课程设计
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用quartus软件开发的数字频率计设计,使用的等精度测量法,用的verilog语言
QUARTUS 频率计
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QUARTUS频率计-数字系统设计的实验报告
QuartusII原理图设计方法
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QuartusII原理图设计方法.详细介绍了各个部分的使用 方法
基于quartus的数字频率计(DDS)设计
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在quartus 里生成正弦波,三角波和锯齿波,每个模块也可以单独生成。
quartus ii13.1 + verilog等精度数字频率计
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4星 · 用户满意度95%
已通过modelsim仿真验证,实际操作中可以串口发生NC和NX的值以供计算,误差<0.01%,频率范围1hz-150Mhz
基于quartusii平台的数字频率计,verilog编程实现
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用QuartusII与FPGA设计等精度频率计
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5星 · 资源好评率100%
这个设计是自己通过找资料(现已经包括在里面了,还包括了我的设计报告)自行设计的。频率测量范围在1Hz~1MHz精度达到0.01%。本文介绍了一种同步测周期计数器的设计,并基于该计数器设计了一个高精度的数字频率计。文中给出了计数器的VHDL编码,并对频率计的FPGA实现进行了仿真验证,给出了测试结果。同时在分析了等精度测频在实现时存在的问题的基础上,介绍了一种基于自适应分频法的频率测量技术,可达到简
数字频率计原理图
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5星 · 资源好评率100%
数字频率计原理图
基于51单片机的数字频率计(源码+原理图)
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采用AT89C52单片机智能控制,结合外围电子电路,设计的频率计性能稳定。在软件设计上采用了单片机的C语言设计,通过单片机内部定时/计数器同时动作,在测量频率时将测频率和测周期相结合,提高了频率计的测量准确性。
基于单片机的数字频率计设计,AD原理图PCB,protues
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基于51单片机数字频率计的设计源程序、仿真图、原理图
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5星 · 资源好评率100%
基于51单片机数字频率计的设计 1.源程序 2.仿真图 3.原理图 4.原理图与仿真图PDF文件
基于51单片机的频率计设计原理图
浏览:119
4星 · 用户满意度95%
51单片机频率计原理图,这里上传的不包括PCB和源程序,如果需要可以给本人留言。可用,频率可以测试到20M,误差很小
等精度频率计(基于quartus ii 平台,用VHDL和基本的模块产生)
浏览:113
4星 · 用户满意度95%
是本人的一门实验课程课题,通过要求,精心写的一份报告,内附vhdl代码,和模块分析
基于QUARTUS的EDA课程设计报告数字频率计的仿真.doc
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5星 · 资源好评率100%
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关于等精度频率计的代码FPGA部分实现原理
浏览:200
5星 · 资源好评率100%
原创文档,实现过程有本人呕心沥血话了数天完成,对于初学者学习有巨大的帮助。
基于quartus ii的一个分频器
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基于quartus ii平台用VHDL语言编程的4M分频器~~~~~~~~~~~~~~~~~~~
频率计程序设计与仿真
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本文档提供了vhdl形式的 频率计程序设计与仿真,有详细的注释,可在quartus上实现。
基于Verilog的数字频率计的代码
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4星 · 用户满意度95%
Vorilog语言编写的数字频率计测频部分的代码,本人毕业设计测频部分实用代码,绝对有效。系统的时钟频率为100M,包含50M的自检信号。
数电课程设计数字频率计
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数电课程设计数字频率计,内容很全面,还有扩展
EDA课程设计-频率计(FPGA代码,quartus软件代码,频率计的设计)
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数字频率计的设计(内含原理图、源代码、实物照片)
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利用STC15系列单片机测量100K~100MHZ的正弦波,幅值为10mv~2V。 课题研究目的: 本课题主要研究如何用单片机来设计数字频率计。因为在电子技术中, 频率的测量十分重要,这就要求频率计要不断的提高其测量的精度和速 度。在科技以日新月异的速度向前发展,经济全球一体化的社会中,简 洁、高效、经济成为人们办事的一大宗旨。在电子技术中这一点表现的 尤为突出,人们在设计电路时,都趋向于用竟可能
基于Quartus II 的dds信号发生器
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产生的信号可以是正弦波或方波、三角波、锯齿波;可以用SignalTap逻辑分析。可以用Model Sim仿真。全部打包在文件中。工程适用版本为Quartus II 13.0,不可低于该版本。 原理:采用DDS技术,将所需生成的波形写入ROM中,按照相位累加原理合成任意波形。 此方案得到的波形稳定,精度高,产生波形频率范围大,容易产生高频。 本实验在设计的模块中,包含以下功能: (1)通过 fre
基于51单片机的数字频率计设计,AD硬件原理图
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AD硬件原理图
基于AVR单片机智能频率计的设计与制作仿真与源程序和原理图
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基于FPGA的频率计与串口通信【设计源码+原理图+说明文档】.rar
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基于FPGA的毕业设计源码
基于TL3016 频率计模块AD设计资料 包含原理图及PCB文件
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基于FPGA的计数器方式频率计
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采用verilog语言及图形连接方式实现的基于FPGA的计数方式频率计。以计数器为基本结构的频率计,内部包含十进制计数模块(CD4518功能)、BCD转数码管译码模块(CD4511功能)、时钟信号处理模块、数值显示模块,其中数值显示包含数码管静态显示及动态扫描方式。使用Aldec Active-HDL 12 64-bit开发实现,内部包含各子功能模块的源代码及测试代码,有简要的说明文件。
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欢迎光临【在手中源码】下载中文网站 http://zszym.taobao.com 本站以FPGA、SOPC、DSP、单片机、嵌入式开发、算法实现为主,源码数量达几十万个,很多都是私家珍藏,互联网上其他地方是找不到的 http://zszym.taobao.com
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android66665
2019-08-23
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zilong08
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