stm32f429数据手册_STM32F103ZET6资源-CSDN文库

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### STM32F429 数据手册解析 #### 概述 STM32F429 是一款基于 ARM Cortex-M4 内核的高性能微控制器（MCU），它结合了强大的处理能力、丰富的外设接口以及低功耗特性，特别适用于需要高速数据处理和复杂图形界面的应用场景。 #### 核心特性 - **处理器**: ARM 32位 Cortex-M4 CPU 集成了浮点单元 (FPU)，支持自适应实时加速器 (ART Accelerator™)，使得在闪存中执行指令时能够实现零等待状态。最高运行频率可达 180 MHz，并且提供了 225 DMIPS（Dhrystone 2.1）的性能指标。 - **内存**: 提供高达 2 MB 的闪存，分为两个可读写分区；高达 256 KB + 4 KB 的 SRAM，其中包含 64 KB 的 CCM（核心耦合内存）数据 RAM；外部存储控制器支持 SRAM、PSRAM、SDRAM 以及 Compact Flash/NOR/NAND 存储器。 - **LCD 控制器**: 支持 VGA 分辨率的 LCD-TFT 控制器，并配备 Chrom-ART Accelerator™ 用于增强图形内容创建功能。 - **时钟与电源管理**: 支持 1.8V 至 3.6V 的工作电压范围；具备多种电源管理模式：睡眠模式、停止模式和待机模式；内置 16 MHz 工厂校准 RC 振荡器、32 kHz RTC 振荡器等。 - **低功耗**: 提供多种低功耗模式，如睡眠模式、停止模式和待机模式；支持 VBAT 供电，可用于 RTC 和备份寄存器。 - **模拟外设**: 包含三个 12 位 2.4 MSPS ADC，最多支持 24 个通道或在三重交错模式下达到 7.2 MSPS；两个 12 位 DAC。 - **定时器**: 配备多达 17 个定时器，包括最多 12 个 16 位定时器和 2 个 32 位定时器，支持 IC/OC/PWM 或脉冲计数和四相编码输入等功能。 - **调试模式**: 支持 SWD & JTAG 接口以及 Cortex-M4 Embedded Trace Macrocell™。 - **输入输出**: 提供高达 168 个可中断 I/O 端口，其中最多 164 个为高速端口（频率可达 84 MHz），并具有 5V 耐受性。 - **通信接口**: 支持多种通信协议，包括最多 3 个 I2C 接口、4 个 USARTs/UARTs、6 个 SPIs、1 个 SAI（串行音频接口）、2 个 CAN 接口以及 SDIO 接口。 #### 外设特性详解 - **LCD 并行接口**: 支持 8080 和 6800 模式，为不同类型的显示器提供兼容性。 - **ADC**: 三个 12 位 ADC 可用于采集模拟信号，每个 ADC 最高采样速率为 2.4 MSPS，在三重交错模式下可达到 7.2 MSPS，适用于高速数据采集应用。 - **DAC**: 两个 12 位 DAC，用于将数字信号转换为模拟信号，例如在音频输出中使用。 - **DMA 控制器**: 通用 DMA 控制器具有 16 个传输流，支持 FIFO 和突发模式，可以有效减轻 CPU 的负担，提高数据传输效率。 - **定时器**: 多达 17 个定时器，其中最多包括 12 个 16 位定时器和 2 个 32 位定时器，支持多种操作模式，如捕获/比较、PWM、脉冲计数等，广泛应用于电机控制、信号发生等领域。 - **通信接口**: 支持多达 21 种通信接口，包括但不限于 I2C、USART/UART、SPI、SAI、CAN 和 SDIO 接口，满足不同应用场景的需求。 STM32F429 系列 MCU 结合了高性能、丰富的外设资源和灵活的电源管理选项，是高性能嵌入式系统设计的理想选择，尤其适合于那些需要高速数据处理能力和复杂图形用户界面的场合。

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May 2013 Doc ID 023140 Rev 2 1/102

STM32F429xx

ARM Cortex-M4 32b MCU+FPU, 225DMIPS, up to 2MB Flash/256+4KB RAM, USB

OTG HS/FS, Ethernet, 17 TIMs, 3 ADCs, 20 comm. interfaces, camera & LCD-TFT

Data brief

Features

• Core: ARM 32-bit Cortex™-M4 CPU with FPU,

Adaptive real-time accelerator (ART

Accelerator™) allowing 0-wait state execution

from Flash memory, frequency up to 180 MHz,

MPU, 225 DMIPS/1.25 DMIPS/MHz

(Dhrystone 2.1), and DSP instructions

• Memories

– Up to 2 MB of Flash memory organized into

two banks allowing read-while-write

– Up to 256+4 KB of SRAM including 64-KB

of CCM (core coupled memory) data RAM

– Flexible external memory controller with up

to 32-bit data bus: SRAM,PSRAM,SDRAM,

Compact Flash/NOR/NAND memories

• LCD parallel interface, 8080/6800 modes

• LCD-TFT controller up to VGA resolution with

dedicated Chrom-ART Accelerator™ for

enhanced graphic content creation (DMA2D)

• Clock, reset and supply management

– 1.8 V to 3.6 V application supply and I/Os

– POR, PDR, PVD and BOR

– 4-to-26 MHz crystal oscillator

– Internal 16 MHz factory-trimmed RC (1%

accuracy)

– 32 kHz oscillator for RTC with calibration

– Internal 32 kHz RC with calibration

• Low power

– Sleep, Stop and Standby modes

–V

BAT

supply for RTC, 20×32 bit backup

registers + optional 4 KB backup SRAM

• 3×12-bit, 2.4 MSPS ADC: up to 24 channels

and 7.2 MSPS in triple interleaved mode

• 2×12-bit D/A converters

• General-purpose DMA: 16-stream DMA

controller with FIFOs and burst support

• Up to 17 timers: up to twelve 16-bit and two 32-

bit timers up to 180 MHz, each with up to 4

IC/OC/PWM or pulse counter and quadrature

(incremental) encoder input

• Debug mode

– SWD & JTAG interfaces

– Cortex-M4 Embedded Trace Macrocell™

• Up to 168 I/O ports with interrupt capability

– Up to 164 fast I/Os up to 84 MHz

– Up to 166 5 V-tolerant I/Os

• Up to 21 communication interfaces

– Up to 3 × I

C interfaces (SMBus/PMBus)

– Up to 4 USARTs/4 UARTs (11.25 Mbit/s,

ISO7816 interface, LIN, IrDA, modem

control)

– Up to 6 SPIs (42 Mbits/s), 2 with muxed

full-duplex I

S for audio class accuracy via

internal audio PLL or external clock

– 1 x SAI (serial audio interface)

– 2 × CAN (2.0B Active) and SDIO interface

• Advanced connectivity

– USB 2.0 full-speed device/host/OTG

controller with on-chip PHY

– USB 2.0 high-speed/full-speed

device/host/OTG controller with dedicated

DMA, on-chip full-speed PHY and ULPI

– 10/100 Ethernet MAC with dedicated DMA:

supports IEEE 1588v2 hardware, MII/RMII

• 8- to 14-bit parallel camera interface up to

54 MBs/s

• True random number generator

• CRC calculation unit

• 96-bit unique ID

• RTC: subsecond accuracy, hardware calendar

Table 1. Device summary

Reference Part number

STM32F429xx

STM32F429VG, STM32F429ZG, STM32F429IG,

STM32F429VI, STM32F429ZI, STM32F429II,

STM32F429BG, STM32F429BI, STM32F429NI,

STM32F429NG

LQFP100 (14 × 14 mm)

LQFP144 (20 × 20 mm)

UFBGA176 (10 × 10 mm)

LQFP176 (24 × 24 mm)

LQFP208 (28 x 28 mm)

TFBGA216 (13 x 13 mm)

&"'!

WLCSP143

www.st.com

Contents STM32F429xx

2/102 Doc ID 023140 Rev 2

Contents

1 Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 7

2 Description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 8

2.1 Full compatibility throughout the family . . . . . . . . . . . . . . . . . . . . . . . . . . .11

3 Functional overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14

3.1 ARM

Cortex™-M4 with FPU and embedded Flash and SRAM . . . . . . . 14

3.2 Adaptive real-time memory accelerator (ART Accelerator™) . . . . . . . . . 14

3.3 Memory protection unit . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 14

3.4 Embedded Flash memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15

3.5 CRC (cyclic redundancy check) calculation unit . . . . . . . . . . . . . . . . . . . 15

3.6 Embedded SRAM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15

3.7 Multi-AHB bus matrix . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 15

3.8 DMA controller (DMA) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 16

3.9 Flexible memory controller (FMC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17

3.10 LCD-TFT controller . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 17

3.11 Chrom-ART Accelerator™ (DMA2D) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18

3.12 Nested vectored interrupt controller (NVIC) . . . . . . . . . . . . . . . . . . . . . . . 18

3.13 External interrupt/event controller (EXTI) . . . . . . . . . . . . . . . . . . . . . . . . . 18

3.14 Clocks and startup . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 18

3.15 Boot modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19

3.16 Power supply schemes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19

3.17 Power supply supervisor . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19

3.17.1 Internal reset ON . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 19

3.17.2 Internal reset OFF . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 20

3.18 Voltage regulator . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21

3.18.1 Regulator ON . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 21

3.18.2 Regulator OFF . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 22

3.18.3 Regulator ON/OFF and internal reset ON/OFF availability . . . . . . . . . . 25

3.19 Real-time clock (RTC), backup SRAM and backup registers . . . . . . . . . . 25

3.20 Low-power modes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26

3.21 V

BAT

operation . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27

Doc ID 023140 Rev 2 3/102

STM32F429xx Contents

3.22 Timers and watchdogs . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 27

3.22.1 Advanced-control timers (TIM1, TIM8) . . . . . . . . . . . . . . . . . . . . . . . . . 28

3.22.2 General-purpose timers (TIMx) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29

3.22.3 Basic timers TIM6 and TIM7 . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29

3.22.4 Independent watchdog . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29

3.22.5 Window watchdog . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 29

3.22.6 SysTick timer . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30

3.23 Inter-integrated circuit interface (I

C) . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30

3.24 Universal synchronous/asynchronous receiver transmitters (USART) . . 30

3.25 Serial peripheral interface (SPI) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31

3.26 Inter-integrated sound (I

S) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31

3.27 Serial Audio interface (SAI1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32

3.28 Audio PLL (PLLI2S) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32

3.29 Audio and LCD PLL(PLLSAI) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 32

3.30 Secure digital input/output interface (SDIO) . . . . . . . . . . . . . . . . . . . . . . . 32

3.31 Ethernet MAC interface with dedicated DMA and IEEE 1588 support . . . 33

3.32 Controller area network (bxCAN) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 33

3.33 Universal serial bus on-the-go full-speed (OTG_FS) . . . . . . . . . . . . . . . . 34

3.34 Universal serial bus on-the-go high-speed (OTG_HS) . . . . . . . . . . . . . . . 34

3.35 Digital camera interface (DCMI) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35

3.36 Random number generator (RNG) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35

3.37 General-purpose input/outputs (GPIOs) . . . . . . . . . . . . . . . . . . . . . . . . . . 35

3.38 Analog-to-digital converters (ADCs) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 35

3.39 Temperature sensor . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

3.40 Digital-to-analog converter (DAC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

3.41 Serial wire JTAG debug port (SWJ-DP) . . . . . . . . . . . . . . . . . . . . . . . . . . 36

3.42 Embedded Trace Macrocell™ . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 36

4 Pinouts and pin description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 38

5 Memory mapping . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 76

6 Package characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 81

6.1 Package mechanical data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 81

6.2 Thermal characteristics . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 94

Doc ID 023140 Rev 2 5/102

STM32F429xx List of tables

List of tables

Table 1. Device summary . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 1

Table 2. STM32F429xx features and peripheral counts. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 9

Table 3. Voltage regulator configuration mode versus device operating mode . . . . . . . . . . . . . . . . 22

Table 4. Regulator ON/OFF and internal reset ON/OFF availability. . . . . . . . . . . . . . . . . . . . . . . . . 25

Table 5. Voltage regulator modes in stop mode . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 26

Table 6. Timer feature comparison. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 28

Table 7. Comparison of I2C analog and digital filters . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 30

Table 8. USART feature comparison . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 31

Table 9. Legend/abbreviations used in the pinout table . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 45

Table 10. STM32F429xx pin and ball definitions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 46

Table 11. FMC pin definition. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 62

Table 12. STM32F429xx alternate function mapping . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 65

Table 13. STM32F429xx register boundary addresses . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 77

Table 14. LQPF100, 14 x 14 mm 100-pin low-profile quad flat package mechanical data. . . . . . . . . 82

Table 15. WLCSP143, 0.4 mm pitch wafe level chip scale package mechanical data. . . . . . . . . . . . 85

Table 16. LQFP144, 20 x 20 mm, 144-pin low-profile quad flat package

mechanical data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 86

Table 17. LQFP176, 24 x 24 mm, 176-pin low-profile quad flat package

mechanical data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 88

Table 18. LQFP208, 28 x 28 mm, 208-pin low-profile quad flat package

mechanical data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 90

Table 19. UFBGA176+25 - ultra thin fine pitch ball grid array 10 × 10 × 0.6 mm

mechanical data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 92

Table 20. TFBGA216 - ultra thin fine pitch ball grid array 13 × 13 × 0.8mm

package mechanical data . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 93

Table 21. Package thermal characteristics. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 94

Table 22. Ordering information scheme . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 95

Table 23. Document revision history . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 101

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