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高速FPGA（NIOS II）系统设计和实现
高速FPGA（NIOS II）系统设计和实现
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高速FPGA（NIOS II）系统设计和实现
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FPGA基于NIOS II的电子钟设计
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使用了Verilog和Sopc两项功能，故在硬件部分使用Verilog编写出数码管的驱动程序，使用NiOS II编写实现过程。 1）使用Qsys生成的定时器timer_1ms实现计时功能； 2）使用8个数码管显示时间； 3）使用3个按钮实现调时间和闹钟时间的功能。 按键1：更换模式（模式0：正常显示时间；模式1：调当前时间的小时；模式2；调当前时间的分钟；模式3：当前时间
基于SoPC/NIOS II的信号发生器设计与实现
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运用基于NIOS II嵌入式处理器的SoPC技术，设计了一个任意信号发生器，不仅可以输出正弦波、方波、三角波和锯齿波等常见波形，且各波形的频率和幅度可调，可根据用户需要进行现场编程，具有控制灵活、输出频率稳定、准确、波形质量好和输出频率范围宽等优点。
基于NIOS II的高速嵌入式指纹识别系统
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为了提高传统指纹识别系统处理速度和安全问题，研究一种基于NIOS II处理器的高速嵌入式指纹识别系统。利用NIOS II的定制指令，FPGA实现算法的硬件设计，同时结合先进的射频识别技术(RFID)，实现了指纹特征模块在非接触IC卡上的存储，在非接触IC卡采用加密算法加强了指纹数据传输的安全性。实验结果表明，系统运行速度快，有较高的安全性。
基于NIOS II的1553B总线测试系统设计
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1553B总线以其可靠性高、实时性好、使用灵活等优点，广泛应用于现代飞机、导弹、卫星、舰艇、坦克等航空、航天、兵器领域，并且逐渐扩展到地铁交通控制等民用领域。而在实际使用过程中，1553B总线由于接口配置复杂，无法直接与PC进行通信，使得系统的安装调试存在困难。利用NIOS II软核处理器面向用户、灵活定制的特性和USB接口方便、支持热插拔的优点，给出了一种在FPGA上已经实现的1553B总线测试
NIOS II和μclinux在工业CT高速数据传输系统的应用
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随着电子技术的高速发展，越来越多的信号处理系统，需要高速的数据采集和大吞吐量的数据传输，来实现数据的高速实时处理能力。在雷达系统中，原始数据中包含丰富的信息，及时获得原始数据并进行实时分析就显得尤为重要，因此在雷达处理机中需要大量使用板间通信，并保证板间数据传输具有高速性和可靠性。单板系统已经不能满足需求，需要多板共同实现。 在数据传输系统中，NIOS Ⅱ嵌入式处理器软核能最大处理200DMI
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Cyclone、APEX,ACEX和HardCopy系列器件中，用户可以获得超过200 DMIPS的性能，用户可以从三种处理器以及超过60个的IP核中选择所需要的，Nios II系统为用户提供了最基本的多功能性，设计师可以以此来创建一个最适合...
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介绍了altera的FPGA的实现某些功能的四种基本方法，也将讲述Nios II EDS的开发过程以及一些外设的开发。 第三章介绍的是U-Boot。简单介绍了U-Boot的历史、代码的结构分析、在XuX开发板使用U-Boot的常用命令、U-Boot...
论NIOS-II系统中A/D数据采集接口的设计与实现
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在FPGA系统中，实现对外部A/D数据采集电路的控制接口逻辑，由于其逻辑功能不是很复杂，因此可采用自定义的方式。采用这种方法进行设计有两种途径。①从软件上去实现。这种方案将NIOS处理器作为一个主控制器，通过编写程序来控制数据转换电路。由于NIOS处理器的工作频率相对于外部设备来说要高出许多，故此种方法会造成CPU资源极大的浪费；②用FPGA 的逻辑资源来实现A/D采集电路的控制逻辑。FPGA有着
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