FPGA DDS IP实现单频 线性调频
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2022-04-25
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FPGA DDS IP 核实现
DDS（Direct Digital Synthesizer），即直接数字频率合成器，本文主要介绍如
何调用 Xilinx 的 DDS IP 核生成某一频率的 Sin 和 Cos 信号，以及 LFM 信号。
1. 相关参数的介绍及求解
（1）DDS 输出频率
输出频率
out
f
是系统时钟频率
clk
f
、相位累加器中相位数据位宽
)(n
B
和相位
增量
的函数。
)(
2
n
B
clk
out
f
f
因此，要得到输出频率
out
f
，要求相位增量
为
clk
B
out
f
f
n )(
2
如果要采用时分复用的多个通道，则降低每个通道的有效时钟效率。对于 C
个通道，要求相位增量为
clk
B
out
f
Cf
n )(
2
（2）频率分辨率
频率分辨率
f
是系统时钟频率
clk
f
和相位累加器数据位宽
)(n
B
的函数。
)(
2
n
B
clk
f
f
对于时分复用的多通道，频率分辨率随通道数的增加而提高，对于 C 个通道：
C
f
f
n
B
clk
)(
2
（3）相位增量
相位增量值是无符号的，当相位增量值与相位位宽匹配时，也可以将其看作
有符号数。假设相位增量和相位数据位宽均为 N，如果看成无符号数，范围由 0
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