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数字逻辑设计第8章 Sequential Logic Design Practices.ppt
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数字逻辑设计第8章 Sequential Logic Design Practices.ppt
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Chapter 8
Sequential Logic Design
Practices
8.1 Sequential-circuit
documentation standards
•
State-machine layout
•
State-machine descriptions
•
Cascaded elements
•
Flip-flops
•
Timing diagrams
•
Timing specifications
3
时钟同步状态机结构
下一状
态逻辑
F
状态
存储器
时钟
输出
逻辑
G
输入
输出
时钟
信号
激励
当前状态
激励方程
驱动方程
状态方程
转移方程
输出方程
4
CLOCK
H
t
L
t
clk
t
触发器输出
ffpd
t
comb
t
组合电路输出
触发器输入
hold
t
setup
t
建立时间容限
setupcomb(max)(max)ffpdclk
tttt ---
保持时间容限
holdcomb(min))min(ffpd
ttt -
5
8.2 Latched and Flip-Flops
•
SSI latches and ip-ops
1Q
1Q
2Q
2Q
3Q
3Q
4Q
4Q
1,2C
1D
2D
3,4C
3D
4D
74x375
D latch
PR
D Q
CLK Q
CLR
74x74
PR
J Q
CLK
K
Q
CLR
74x109
PR
J Q
CLK
K
Q
CLR
74x112
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