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STM32F407-14.3.10-表73具有有断路功能的互补通道OCx和OCxN的输出控制位-00x00-01x11
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2024-01-05
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如上表73所示,主输出使能(MOE=0)的8种OCx与OCxN的输出状态及波形图,已经单独整理输出8篇文章,方便需要时单独回查。 根据表73可得以下结论 1、从00x00~01x00的前5种状态的OCx与OCxN的引脚电平全由GPIO端口的上下拉决定。 2、从01x01~01x11的后3种状态主要取决于 OISx,OISxN,CCxP,CCxNP之间的关系(详见下部框图)
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1
TIMx断路和死区寄存器
TIMxbreakanddeadtimeregister
TIMx_BDTR位[15]
只要断路输入变为有效状态,此位便由硬件异步清零。
此位由软件置1,也可根据AOE位状态自动置1。
此位仅对配置为输出的通道有效。
0:OC和OCN输出禁止或被强制为空闲状态。
1:如果OC和OCN输出的相应使能位(TIMx_CCER寄存器中的CCxE和CCxNE位)均置1,则 使能OC
和OCN输出。
有关详细信息,请参见OC/OCN使能说明( 第379页的第14.4.9节: TIM1和TIM8捕获/比较使能寄
存器(TIMx_CCER))。
MOE=1
主输出使能
Mainoutputenable
TIMx_CH1
TIMx_CH1N
0
1
0
1
OC1N
TIMx断路和死区寄存器
TIMxbreakanddeadtimeregister
TIMx_BDTR位[10]
此位在MOE=0时作用于配置为输出的通道。
有关详细信息,请参见OC/OCN使能说明( 第379页的第14.4.9节: TIM1和TIM8捕获/比较使能寄
存器(TIMx_CCER))。
0:处于无效状态时,禁止OC/OCN输出(OC/OCN使能输出信号=0)。
1:处于无效状态时,一旦CCxE=1或CCxNE=1,便将OC/OCN输出首先强制为其空闲电平。然后设置
OC/OCN使能输出信号=1
注意:编程了 LOCK(TIMx_BDTR寄存器中的 LOCK位)级别 2后,此位即无法修改。
OSSI=1
空闲模式下的关闭状态选择
Off‐stateselectionforIdlemode
0
1
OC1
OC1
OC1N
01
10
11
TIMx捕获/比较使能寄存器
TIMxcapture/compareenableregister
TIMx_CCER位[0]
CC1通道配置为输出:
0:关闭‐‐OC1未激活。OC1电平是MOE、OSSI、OSSR、OIS1、OIS1N和
CC1NE位的函数。
1:开启‐‐OC1信号是相应输出引脚上的输出,具体取决于
MOE、OSSI、OSSR、OIS1、OIS1N和CC1NE位。
CC1通道配置为输入:此位决定了是否可以实际将计数器值捕获到输入捕
获/比较寄存器1(TIMx_CCR1)中。
0:禁止捕获。
1:使能捕获。
注意:此位将在具有互补输出的通道上进行预装载。如果TIMx_CR2寄存
器中的CCPC位置1,则仅当生成换向事件时,CC1E有效位才会从
预装载位获取新值。
CC1E=0
捕获/比较1输出使能
Capture/Compare1outputenable
TIMx捕获/比较使能寄存器
TIMxcapture/compareenableregister
TIMx_CCER位[2]
0:关闭‐‐OC1N未激活。OC1N电平是MOE、OSSI、OSSR、OIS1、OIS1N
和CC1E位的函数。
1:开启‐‐在相应输出引脚上输出OC1N信号,具体取决于
MOE、OSSI、OSSR、OIS1、OIS1N和CC1E位。
注意:此位将在具有互补输出的通道上进行预装载。如果TIMx_CR2寄存
器中的CCPC位置1,则仅当生成换向事件时,CC1NE有效位才会从
预装载位获取新值。
CC1NE=1
捕获/比较1互补输出使能
Capture/Compare1complementaryoutputenable
00
异步
时钟有效
TIMx捕获/比较使能寄存器
TIMxcapture/compareenableregister
TIMx_CCER位[1]
CC1通道配置为输出:
0:OC1高电平有效
1:OC1低电平有效
注意:此位将在具有互补输出的通道上进行预装载。如果 TIMx_CR2寄存器中的 CCPC位置1,则
仅当生成换向事件时, CC1P有效位才会从预装载位获取新值。
注意:只要编程了 LOCK(TIMx_BDTR寄存器中的LOCK 位)级别2或 3,此位立即变为不可写状
态。
CC1通道配置为输入:
CC1NP/CC1P位可针对触发或捕获操作选择TI1FP1和TI2FP1的有效极性。
00:非反相/上升沿触发电路对TIxFP1上升沿敏感(在复位模式、外部时钟模式或触发模式下执
行捕获或触发操作),TIxFP1未反相(在门控模式或编码器模式下执行触发操作)。
01:反相/下降沿触发电路对TIxFP1下降沿敏感(在复位模式、外部时钟模式或触发模式下执行
捕获或触发操作),TIxFP1反相(在门控模式或编码器模式下执行触发操作)。
10:保留,不使用此配置。
11:未反相/边沿触发。电路对TIxFP1上升沿和下降沿都敏感(在复位模式、外部时钟模式或触
发模式下执行捕获或触发操作),TIxFP1未反相(在门控模式下执行触发操作)。编码器
模式下不得使用此配置。
CC1P=0
捕获/比较1输出极性
Capture/Compare1outputpolarity
OIS1N=0
输出空闲状态1(OC1N输出)
(OutputIdlestate1(OC1Noutput))
TIMx控制寄存器 2
TIMxcontrolregister2
TIMx_CR2位[9]
0:当MOE=0时,经过死区时间后OC1N=0
1:当MOE=0时,经过死区时间后OC1N=1
注意:只要编程了LOCK(TIMx_BDTR寄存器中的LOCK
位)级别1、2或3,此位即无法修改。
异步
时钟有效
TIMx捕获/比较使能寄存器
TIMxcapture/compareenableregister
TIMx_CCER位[3]
CC1通道配置为输出:
0:OC1N高电平有效。
1:OC1N低电平有效。
注意: 此位将在具有互补输出的通道上进行预装载。如果 TIMx_CR2寄存器中的 CCPC位置 1,则仅当生成换向事件
时,CC1NP有效位才会从预装载位获取新值。
注意: 只要编程了 LOCK(TIMx_BDTR寄存器中的 LOCK位)级别 2或 3且 CC1S=“00” (通道配置为输出),
此位立即变为不可写状态。
CC1通道配置为输入:
此位与 CC1P配合使用,用以定义 TI1FP1和 TI2FP1的极性。请参见 CC1P说明。
CC1NP[0]=1
捕获/比较1互补输出极性
Capture/Compare1complementaryoutputpolarity
10
01
11
00
禁止输出,不由定时器驱动(如交还给GPIO上下拉控制)
禁止输出,不由定时器驱动(如交还给GPIO上下拉控制)
XOR
OIS1=1
输出空闲状态1(OC1输出)
(OutputIdlestate1(OC1output))
TIMx控制寄存器 2
TIMxcontrolregister2
TIMx_CR2位[8]
0:当MOE=0时,(如果OC1N有效,则经过死区时间之后)OC1=0
1:当MOE=0时,(如果OC1N有效,则经过死区时间之后)OC1=1
注意:只要编程了 LOCK(TIMx_BDTR寄存器中的 LOCK位)级别 1、2或3,此位
即无法修改。
TIMx捕获/比较使能寄存器
TIMxcapture/compareenableregister
TIMx_CCER位[1]
CC1通道配置为输出:
0:OC1高电平有效
1:OC1低电平有效
注意:此位将在具有互补输出的通道上进行预装载。如果 TIMx_CR2寄存器中的 CCPC位置1,则
仅当生成换向事件时, CC1P有效位才会从预装载位获取新值。
注意:只要编程了 LOCK( TIMx_BDTR寄存器中的LOCK 位)级别2或 3,此位立即变为不可写状
态。
CC1通道配置为输入:
CC1NP/CC1P位可针对触发或捕获操作选择TI1FP1和TI2FP1的有效极性。
00:非反相/上升沿触发电路对TIxFP1上升沿敏感(在复位模式、外部时钟模式或触发模式下执
行捕获或触发操作),TIxFP1未反相(在门控模式或编码器模式下执行触发操作)。
01:反相/下降沿触发电路对TIxFP1下降沿敏感(在复位模式、外部时钟模式或触发模式下执行
捕获或触发操作),TIxFP1反相(在门控模式或编码器模式下执行触发操作)。
10:保留,不使用此配置。
11:未反相/边沿触发。电路对TIxFP1上升沿和下降沿都敏感(在复位模式、外部时钟模式或触
发模式下执行捕获或触发操作),TIxFP1未反相(在门控模式下执行触发操作)。编码器
模式下不得使用此配置。
CC1P=0
捕获/比较1输出极性
Capture/Compare1outputpolarity
XOR
OIS1N=0
输出空闲状态1(OC1N输出)
(OutputIdlestate1(OC1Noutput))
TIMx控制寄存器 2
TIMxcontrolregister2
TIMx_CR2位[9]
0:当MOE=0时,经过死区时间后OC1N=0
1:当MOE=0时,经过死区时间后OC1N=1
注意:只要编程了LOCK(TIMx_BDTR寄存器中的LOCK
位)级别1、2或3,此位即无法修改。
TIMx捕获/比较使能寄存器
TIMxcapture/compareenableregister
TIMx_CCER位[3]
CC1通道配置为输出:
0:OC1N高电平有效。
1:OC1N低电平有效。
注意: 此位将在具有互补输出的通道上进行预装载。如果 TIMx_CR2寄存器中的 CCPC位置 1,则仅当生成换向事件
时,CC1NP有效位才会从预装载位获取新值。
注意: 只要编程了 LOCK(TIMx_BDTR寄存器中的 LOCK位)级别 2或 3且 CC1S=“00” (通道配置为输出),
此位立即变为不可写状态。
CC1通道配置为输入:
此位与 CC1P配合使用,用以定义 TI1FP1和 TI2FP1的极性。请参见 CC1P说明。
CC1NP[0]=1
捕获/比较1互补输出极性
Capture/Compare1complementaryoutputpolarity
0
1
OIS1=1
输出空闲状态1(OC1输出)
(OutputIdlestate1(OC1output))
TIMx控制寄存器 2
TIMxcontrolregister2
TIMx_CR2位[8]
0:当MOE=0时,(如果OC1N有效,则经过死区时间之后)OC1=0
1:当MOE=0时,(如果OC1N有效,则经过死区时间之后)OC1=1
注意:只要编程了 LOCK(TIMx_BDTR寄存器中的 LOCK位)级别 1、2或3,此位
即无法修改。
禁止输出,不由定时器驱动(如交还给GPIO上下拉控制)
禁止输出,不由定时器驱动(如交还给GPIO上下拉控制)
0
1
1
1
1
0
1
01
0
0
0
0
1
0
1
0
1
1
1
0
0V
3.3V
表73具有有断路功能的互补通道OCx和OCxN的输出控制位‐01x01详细框图
MOE=0, OSSI=1, OSSR=x, CC1E=0, CC1NE=1,
OIS1=1, OIS1N=0,
CC1P=0, CC1NP=1
‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐
‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐‐
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