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xapp1017-lvds-ddr-deserial_UP_XAPP1017_
共14个文件
v:6个
vhd:5个
xdc:1个
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2021-09-30
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LVDS Source Synchronous DDR Deserialization (up to 1
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xapp1017-lvds-ddr-deserial.zip (14个子文件)
Project
Verilog_top_level_examples
top16_ddr_rx.v 6KB
xdc
top16_ddr_rx.xdc 10KB
Verilog_macros
serdes_1_to_468_idelay_ddr.v 20KB
delay_controller_wrap.v 16KB
serdes_1_to_10_idelay_ddr.v 33KB
Uncertainties_ tool_ 1.1.xlsx 15KB
VHDL_macros
serdes_1_to_468_idelay_ddr.vhd 23KB
delay_controller_wrap.vhd 18KB
VHDL_top_level_examples
top16_ddr_rx.vhd 8KB
Verilog_testbench
serdes_n_to_1_7_series.v 13KB
tb_top16_ddr_rx.v 4KB
VHDL_testbench
tb_top16_ddr_rx.vhd 7KB
serdes_n_to_1_7_series.vhd 14KB
readme.txt 6KB
共 14 条
- 1
资源评论
- m0_671675732022-12-07感谢大佬分享的资源给了我灵感,果断支持!感谢分享~
- ihaveicando2023-04-12终于找到了超赞的宝藏资源,果断冲冲冲,支持!
- 2301_768884392023-12-28资源很受用,资源主总结的很全面,内容与描述一致,解决了我当下的问题。
余淏
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