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verzlojfood.zip_rs verilog_按钮控件
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RS码的FPGA实现,verilog语言形式,好参考资料
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rs_encoder.zip_RS_ENCODER_rs_rs verilog
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适应多个模式的rs编码,Verilog,选择对应的多项式
bch.zip_BCH verilog_BCH、verilog_Flip Flop!_Verilog bch_rs verilo
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Experimental report VHDL VHDL verilog rs flip-flop experiment experimental report VHDL VHDL verilog rs flip-flop experiment
Uart.zip_RS422串口 verilog_Verilog RS422_rs422 verilog_verilog R
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RS422通信程序,Verilog语言,此模块实现422通信功能
nor_flash_verilog.zip_FPGA NOR flash_nor flash verilog_nor flas
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fpga verilog实现 S29GL256S 系列 并行 nor flash 的读写擦除操作功能。 verilog源代码。
async--RS232.zip_RS232Verilog_fpga asy_rs232 vhdl_rs232verilog代码
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async--RS232VERILOG HDL原代码
nwsm.rar_BCH verilog_BCH译码器_bch_news68y_按钮控件
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用verilog编写的bch译码器,包括测试文件,随机加载了比特流,进行了测试,
crc_verilog_xilinx.zip_CRCGEN.PL_Verilog crc_crc verilog_crc32_c
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包括下面文档: readme.txt : This file crc8_8.v : CRC-8, 8-bit data input. crc12_4.v : CRC-12, 4-bit data input. ... crcgen.pl : Perl script used to generate Verilog Source for CRC caluculation.
eda.zip_LIFO verilog_SRAM_modelsim verilog_sram verilog _verilog
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在Verilog HDL中使用任务(task), 利用有限状态机进行时序逻辑的设计,利用SRAM设计一个LIFO
EDA.zip_EDA verilog_verilog_verilog pwm_verilog pwm led_verilog
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verilog 练习的 基本程序 流水灯 ,PWM ,按键消抖,等基本程序 ,经过 一一验证
DES_verilog.zip_DES verilog_DES Verilog_Verilog des_des
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用verilog实现的DES(Data Encryption Standard数据加密标准),把64位明文输入变为64位密文输出块。
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用verilog语言对svpwm的仿真出来,可用于交流电机调速
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v.zip_TEA verilog_algorithms_rc4 verilog_rc4.v_verilog rc4
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Synthetisable verilog of compact crypto algorithms: RC4, TEA, XTEA, XXTEA. A faster but, more resource hungry version for RC4 and XXTEA is included.
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UART1.zip_TDFGVD_rs232 verilog_urt1_varietyy9h_串口 verilog
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jts-1.14.zip
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jts-1.14.zip
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verzlojfood.zip
(4个子文件)
srs-codec-8-2.tgz
16KB
rs-codec-8-4.tgz
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Ers-codec-5-6.tgz
16KB
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21KB
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