CLK_160M .set 09007H ; PLL*10
CLK_80M .set 04007H ; PLL*5
CLK_32M .set 01007H ; PLL*2
CLK_16M .set 0F007H ; PLL*1
****************************************************************************
* 设置时钟频率 *
****************************************************************************
STM #0B,CLKMD ;switch to DIV mode(往CLKMD中写立即数0,B表示是二进制数)
TstSatu:LDM CLKMD,B
AND #01B,B ;poll STATUS bit
BC TstSatu,BNEQ
STM CLK_32M,CLKMD ;switch to PLL X 10 mode
PllSatu:LDM CLKMD,B
AND #01B,B ;poll STATUS bit
BC PllSatu,BEQ
dct.rar_TI DCT_dct_dct 图像处理
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2022-09-20
14:37:20
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