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fpga.zip_BCH、verilog_FPGA verilog_fpga编码_编码verilog
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fpga_verilog
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使用verilog语言实现的bch3226编码
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fpga-verilog交通灯.zip
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本资源为用Verilog编写的交通灯代码,欢迎下载。本人采用的是Quarters,下载即可用,可编程逻辑器件类课程需要的有缘人可自行下载
fpga直流电机verilog.zip
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本资料归于网络整理,仅供参考学习用。如有侵权,请联系删除!! qq:1391074994 1. 资料都是有论文和程序的,程序大部分是quartus的工程,有几个是ise或者vivado的工程,代码文件就是里面的V文件。 2. 我收集的每个小项目都会开源出来,欢迎关注我的博客并下载学习。 3. 每个项目的实际的项目要求和实现的现象我就不挨个去描述了,太多了!!40多个小项目。(一个包里面只有一个小项
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西安交通大学数电FPGA实验代码,使用verilog编写
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关于BCH的编码器和译码器,可实现16位,32位,64位,128位的编码和译码纠错,2位纠错,Verilog实现
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BCH code Open Source
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用verilog编写的bch译码器,包括测试文件,随机加载了比特流,进行了测试,
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用verilog编写的RS_BCH的编码
USB_FPGA.zip_EP3C25_FPGA verilog_usb fpga verilog_verilog hdl
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基于Cyclone EP3C25的USB与CY60183传递数据的FIFO Verilog HDL源代码(FPGA端程序)
BCH.zip_BCH c++ code_bch_bch verilog_bch decoder_条形码
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一个解码的类,常用在条形码的解码中,是老外写的比较实用
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用verilog编写的bch译码器,包括测试文件,随机加载了比特流,进行了测试,
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可配置BCH编码Verilog硬件实现
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可配置BCH编码Verilog硬件实现,能够根据用户需求实现对应的BCH编码,进而实现可靠数据传输和通信
基于verilog实现BCH码
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基于cyclone系列,通过verilog语言实现BCH编码。BCH码是一种常用的线性分组码,这种编码方式能够检验并纠正1~3葛错误,具有较高的编码效率
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BCH码verilog源码(peterson算法)
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可配置BCH解码Verilog硬件实现,能够按照用户配置实现不同位宽下的BCH解码操作,可靠性高,能够满足不同用户的实际需求。
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RS译码verilog代码
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RS(204,188)的verilog代码 通过quartus9.0综合仿真
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fpga.zip
(3个子文件)
fpga
decode_32_26.v
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decode_32_26_tb.v
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