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processor_demo:在Altera DE2-115板上测试微处理器回购的设置
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2021-04-08
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processor_demo 在Altera DE2-115板上测试微处理器回购协议( )和IIR系统识别的设置 尝试适配最多8个权重的过滤器(直接形式I,前馈+反馈)。 实现除寄存器外的所有元素,从寄存器到乘法器,乘累加,fpu。 FPGA逻辑元素的数量可能是一个限制。 滤波后的音频信号被馈送到系统,该系统执行全梯度IIR LMS算法以识别所使用的滤波器(猜测其系数)。 从文件读取输入和先前的输出,应用IIR过滤器,然后将新的输出写入data_out输出。 处理器读取该输出,将其与所需的响应进行比较,执行计算并更新滤波器系数。 处理器每个周期执行1条指令,其时钟以10 MHz运行。 它将添加以下硬件:内部乘积,地址解码,可能的矢量乘以标量和矢量加法。 由于文件是通过对以44100 Hz记录的音频样本进行降采样(2x)生成的,因此滤波器采样频率为22050 Hz。 为了
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processor_demo-master.zip (40个子文件)
processor_demo-master
vmac.vhd 7KB
.gitignore 142B
processor_demo.qsf 10KB
testbench.vhd 6KB
adaptive_filter.m 2KB
filtro.m 4KB
filter_xN.vhd 3KB
address_decoder_memory_map.vhd 2KB
generic_coeffs_mem.vhd 2KB
mmu.vhd 5KB
pll.cmp 987B
binary_to_bcd_digit.vhd 3KB
pll.qip 416B
esquema de uso do D-cache.png 11KB
filter.vhd 8KB
var_shift.vhd 2KB
fpu_inner_product.vhd 3KB
pins using 50MHz.csv 5KB
i2s_master_transmitter
pll_5MHz.ppf 466B
binary_to_bcd.vhd 5KB
interrupt_controller.vhd 4KB
.gitmodules 344B
pll.vhd 15KB
microprocessor
processor_demo pins.csv 4KB
pll_5MHz.cmp 992B
README.md 2KB
processor_demo.qpf 1KB
processor_demo.vhd 28KB
pll_5MHz.qip 431B
tb_fp32_to_integer.vhd 2KB
decimal_converter.vhd 4KB
fp32_to_integer.vhd 4KB
shift_register.vhd 1KB
pll_5MHz.vhd 15KB
pll.ppf 461B
i2c_master
inner_product_calculation_unit.vhd 5KB
7seg_controller.vhd 2KB
prescaler.vhd 1KB
address_decoder_register_map.vhd 2KB
wren_ctrl.vhd 2KB
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jackie陈
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