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verilog-examples:各种有用的Verilog示例
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2021-05-15
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Verilog示例 存储库已移至: : 各种有用的Verilog示例。 介绍 我用于教授Verilog的一些Verilog示例,也可能对其他项目有用。 大多数(如果不是全部)示例都使用进行了测试。 您是Verilog的新手吗? Verilog是一种硬件描述语言。 使用Verilog,您可以设计数字硬件,从简单的控制器到完整的微处理器。 借助Verilog和现场可编程门阵列(FPGA)芯片之类的硬件描述语言(HDL),任何人都可以设计和构建自己的硬件。 在这里,您可以从以下两个地方开始: 我的数字电路入门课程仅使用Verilog示例(目前仅使用西班牙语)。 -以最实用,最免费的方式学习数字设计和Verilog。 范例清单 最详尽的一些示例包括其自己的README.md文件,并带有详细说明。 其他示例包括源代码中的所有相关信息。 一些示例提出了一些练习。 突出显示了精选示例。
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verilog-examples-master.zip (20个子文件)
verilog-examples-master
.gitignore 45B
README.md 2KB
debouncer
debouncer.v 4KB
debouncer_tb.v 3KB
seg7-display-txt
seg7-display-hex_tb.v 2KB
README.md 10KB
seg7-display.v 10KB
seg7-display_tb.v 3KB
seg7.vh 1KB
bin-bcd
bin_to_bcd_8_tb.v 1KB
bin_to_bcd_14.v 2KB
bin_to_bcd_13.v 2KB
bin_to_bcd_8.v 2KB
bcd-7
bcd-7.v 1KB
bcd-7_tb.v 2KB
seg7-4d-display-simple
display-ctrl.v 4KB
seg7-4d-display
seg7_4d_ctrl.v 18KB
boards
Basys2
seg7_4d_ctrl_test.ucf 5KB
bin-gray
gray_tb.v 2KB
gray.v 1KB
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小小鹊
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