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CMPE_297-1_CourseProject:CMPE 297-1的课程项目
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2021-03-18
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CMPE_297-1_CourseProject CMPE 297-1的课程项目。 项目设置 创建ZYBO目标项目 链接github源(不要选择复制到项目;选择从子目录添加)a)将'design / src'添加为设计源目录b)添加'ver / dat / a4_polling.dat'作为设计源c)添加'design / constraints /Zybo-Z7.xdc'作为约束文件 创建axi_dut_iface AxiIp a)工具>创建并打包新IP>创建名为'axi_dut_iface'的新AXI4 Periph b)从'design / src / axi_ip / *。v'替换磁盘上的axi_ip源c)窗口> IP目录;搜索axi_dut_iface,[右键单击]在IP Packager中编辑d)'合并';查看并打包>重新打包IP 块设计(实验性..)a)添加“ design
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CMPE_297-1_CourseProject-main.zip (74个子文件)
CMPE_297-1_CourseProject-main
.gitignore 75B
bin
bitstream.bit.bin 3.86MB
val
results
.emptyfile 0B
src
buildAll.sh 134B
common
AddressMapper.hpp 172B
AddressMapper.cpp 1KB
Constants.hpp 172B
mainA4.cpp 2KB
zybo-ui
Makefile 118B
driver.h 3KB
driver.c 3KB
README.md 429B
t5.c 6KB
draw.h 6KB
draw.md 3KB
ver
testbenches
.emptyfile 0B
waveforms
.emptyfile 0B
dat
a4_polling.dat 153B
asm
a4_polling.asm 693B
scripts
load-driver.tcl 143B
mkdir_firmware 23B
gen-bitbin.tcl 467B
load-bitbin.tcl 211B
make_driver 16B
load-all.tcl 76B
echo_bitstream 82B
README.md 3KB
localbin
.emptyfile 0B
design
src
axi_ip
axi_dut_iface_v1_0.v 3KB
axi_dut_iface_v1_0_S00_AXI.v 18KB
gpio
gpio_top.v 2KB
gpio_ad.v 243B
mips
mips.v 6KB
fpga
clk_gen.v 718B
hex_to_7seg.v 824B
led_mux.v 808B
button_debouncer.v 695B
mips_fpga.v 4KB
wrapper.v 2KB
controlunit
maindec.v 4KB
controlunit.v 3KB
auxdec.v 1KB
7seg_cap.v 798B
datapath
multiplier.v 192B
dreg.v 611B
adder.v 148B
mux2.v 227B
alu.v 522B
signext.v 131B
datapath.v 16KB
regfile.v 727B
mips_top.v 1KB
memory
dmem.v 1024B
imem.v 216B
fact
fact_top.v 1KB
fact_cu.v 2KB
fact_dp.v 1KB
fact.v 666B
fact_ad.v 449B
fact_reg.v 250B
intc
priority_encoder.v 1KB
intc.v 2KB
soc
system.v 7KB
intc.v 167B
address_decoder.v 1KB
wrapper_v4.v 2KB
fpga_top.v 2KB
tb_system.v 651B
helper.v 2KB
constraints
Zybo-Z7.xdc 16KB
block
design_1.bd 82KB
diagrams
MipsContextSwitch.drawio 7KB
CMPE297-1_Group3_BlockDiagram.drawio 193KB
.emptyfile 0B
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莊謙
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