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RISC-V超标量BOOM的源存储库riscv-boom.zip
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2019-07-19
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伯克利乱序执行RISC-V处理器(The Berkeley Out-of-Order RISC-V Processor)。 riscv-boom 是用Chisel硬件构造语言编写的RV64G RISC-V超标量Berkeley乱序机(BOOM)的源存储库。 BOOM是一个可合成的核心,目标ASIC过程。 它可以在FPGA(zc706上为50 MHz)上运行,但是将其优化为FPGA软核是一个非目标。 RISC-V BOOM(45nm)与ARM Cortex A9(40nm)在台积电(TSMC)的40/45纳米工艺下对比胜于A9。 与其它工业产品对比优势依然。 芯片面积对比
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RISC-V超标量BOOM的源存储库riscv-boom.zip (173个子文件)
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.gitignore 7B
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ISSUE_TEMPLATE.md 992B
README.md 824B
README.md 667B
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lsu.png 502KB
functional-unit-hierarchy.png 297KB
rename-pipeline.png 251KB
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functional-unit-fpu.png 137KB
tage.png 123KB
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chip.png 119KB
issue_slot.png 110KB
2bc-prediction.png 24KB
btb.png 12KB
pipeview-helper.py 9KB
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backing-predictor.rst 24KB
execution-stages.rst 16KB
reorder-buffer.rst 8KB
load-store-unit.rst 7KB
instruction-fetch-stage.rst 6KB
boom-ecosystem.rst 6KB
rename-stage.rst 6KB
nl-predictor.rst 5KB
debugging.rst 5KB
issue-units.rst 4KB
uarch-counters.rst 4KB
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physical-realization.rst 4KB
terminology.rst 4KB
rocket-chip.rst 3KB
boom-repository.rst 3KB
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reg-file-bypass-network.rst 2KB
future-work.rst 2KB
verification.rst 2KB
riscv-isa.rst 2KB
index.rst 2KB
memory-system.rst 2KB
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index.rst 829B
index.rst 641B
decode-stage.rst 423B
chisel.rst 328B
faq.rst 201B
bibliography.rst 95B
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plugins.sbt 68B
lsu.scala 60KB
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decode.scala 51KB
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fetch-control-unit.scala 33KB
functional-unit.scala 32KB
icache.scala 27KB
execution-unit.scala 24KB
func-unit-decode.scala 21KB
tage.scala 17KB
util.scala 16KB
dcache-shim.scala 16KB
dense-btb.scala 14KB
frontend.scala 14KB
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