基于CPLD及FPGA的VHDL语言电路优化设计

在VHDL语言电路优化设计当中，优化问题主要包括面积优化和速度优化。面积优化是指CPLD／FPGA的资源利用率优化，即用尽可能少的片内资源实现更多电路功能；速度优化是指设计系统满足一定的速度要求。