FPGA/EPLD的自上而下设计方法

FPGA/EPLD的自上而下(Top-Down)设计方法：　　传统的设计手段是采用原理图输入的方式进行的，如图1所示。通过调用FPGA/EPLD厂商所提供的相应物理元件库，在电路原理图中绘制所设计的系统，然后通过网表转换产生某一特定FPGA/EPLD厂商布局布线器所需网表，通过布局布线，完成设计。原理图绘制完成后可采用门级仿真器进行功能验证。　　 　　图1:传统的设计手段与Top-Down设计工具的比较　　然而，工程师的最初设计思想不是一开始就考虑采用某一FPGA/EPLD厂商的某一特定型号器件，而是从功能描述开始的。设计工程师首先要考虑规划出能完成某一具体功能、满足自己产品系统设计要求的某一功能模块，利用某种方式(如HDL硬件描述语言)把功能描述出来，通过功能仿真(HDL仿真器)以验证设计思路的正确性。当所设计功能满足需要时，再考虑以何种方式(即逻辑综合过程)完成所需要的设计，并能直接使用功能定义的描述。实际上这就是自顶而下设计方法。　　与传统电原理图输入设计方法相比，Top-Down设计方法具体有以下优点：　　1、完全符合设计人员的设计思路，从功能描述开始，到物理实现的完成。　　2