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Matlab代码verilog-sw_github:sw_github
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2021-05-27
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Matlab代码verilog 数据结构 这是关于“数据结构”的。 所有代码都与数据结构类有关。 代码的某些部分来自该类。 stack_merge_1 :合并两个堆栈,然后创建新堆栈。 但只使用推和弹出 两个堆栈是{0,1,2,3,4}和{5,6,7,8,9} 首先放置{0,1,2,3,4},然后放置{5,6,7,8,9} 推送后,获得一个新堆栈,该堆栈为{0,1,2,3,4,5,6,7,8,9} 从9跳到0 stack_merge_2 :合并两个堆栈,然后创建新堆栈。 但只使用推和弹出 与stack_merge_1相同,但需要得到不同的结果 前两个堆栈是{0,1,2,3,4}和{5,6,7,8,9} 轮流推动每个元素 推送后,获得一个新堆栈,该堆栈为{0,5,1,6,2,7,3,8,4,9} 从9跳到0 SoC_编程 这是关于“ Soc编程”的。 所有代码都与该班级有关,并为此进行了编程。 编程语言是verilog。 棒球比赛 :该班级的项目。 使用TEXTLCD,LED,7段,TXTLCD,按钮 硬件 :课堂作业 代码的某些部分来自pdf类 代码的某些部分用于家庭作业 learni
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sw_github-master.zip (50个子文件)
sw_github-master
Information_theory
channel_coding
channel_coding.m 5KB
computation.m 2KB
test_channel.m 953B
set_path.m 4KB
set_path_simple 1KB
README.md 2KB
set_path2.m 69KB
huffman_coding
huffman3.m 3KB
Huffman_coding_algorithm.m 2KB
README.md 2KB
huffman2.m 3KB
SoC_programming
project
seven_seg.v 2KB
CHAR_TOP.v 4KB
VIDEO_OUT.v 1014B
bin2seg.v 539B
CHAR_GEN.v 3KB
CHAR_GEN_ROM.v 55KB
README.md 483B
SVGA_TIMING_GENERATION.v 8KB
textlcd.v 5KB
main.c 11KB
CHAR_DISPLAY.v 7KB
HW
clag.v 813B
adder.v 325B
testbench_CLA.v 1KB
cla_16bits.v 2KB
result.txt 20.77MB
cla_4bits.v 1KB
README.md 5KB
studying_verilog
decoder.v 803B
jk_flip_flop
tb_jk_ff.v 961B
jk_ff.v 451B
vending_machine
tb_vending_machine.v 1KB
vending_machine.v 2KB
mux_4.v 559B
BCD
bcd_counter.v 803B
tb_bcd_counter.v 717B
jk_ff.v 451B
ripple_carry
half_adder.v 217B
ripple_carry_adder.v 957B
full_adder.v 522B
mux.v 389B
README.md 2KB
SUMMARY.md 6KB
Data_structure
stack_merge_1
Makefile 60B
README.md 344B
foo.c 2KB
stack_merge_2
Makefile 60B
README.md 343B
foo.c 2KB
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