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eth.zip_VHDL/FPGA/Verilog_VHDL_
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VHDL/FPGA/Verilog
VHDL
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eth.zip
(6个子文件)
eth
cm_channel_decode.v
21KB
cm_sig_top.v
33KB
ul_cm_sig_top.v
18KB
cm_channel_encode.v
20KB
dl_cm_sig_top.v
19KB
opt_channel_sel.v
15KB
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