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扰码器Verilog.rar_VHDL/FPGA/Verilog_VHDL_

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VHDL/FPGA/Verilog

VHDL

5星 · 超过95%的资源 1 下载量 102 浏览量 2021-08-10 00:53:49 上传评论 1 收藏 509KB RAR 举报

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实现扰码的功能，主要为64位在pcs子层传输的扰码器设计

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2301_77485312

2023-12-17

资源不错，内容挺好的，有一定的使用价值，值得借鉴，感谢分享。

pudn01

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