夏宇闻Verilog经典教程
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2010-11-13
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Verilog数字系统设计教程（夏宇闻）例题源 上册例题 
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counter.v 493B cputop.v 7KB machinectl.v 351B test1.pro 3KB addr_decode.v 507B rom.v 220B ram.v 336B clk_gen.v 3KB register.v 745B accum.v 350B test2.dat 442B machine.v 4KB test2.pro 1KB test1.dat 442B alu.v 846B test3.dat 494B adr.v 345B datactl.v 307B test3.pro 1KB cpu.v 2KB 第4章例题.doc 34KB 第8章例题.doc 171KB 第12章例题.doc 51KB 第11章例题.doc 30KB 第16章例题 I2Cdesign top.v 1KB signal.v 4KB data.dat 61B eeprom_wr.v 17KB addr.dat 62B eeprom.v 5KB 第14章例题.doc 66KB 第2章例题.doc 39KB 第15章例题.doc 64KB 第16章例题.doc 106KB 下册例题 练习11.doc 112KB 练习10.doc 45KB 练习12.doc 54KB 练习1-9.doc 96KB 关于下册例题的说明.doc 20KB资源评论
