5
5
4
4
3
3
2
2
1
1
D D
C C
B B
A A
【FPGA PIO】
High Speed Interface
【FPGA SYSCLK】
【FPGA NET】
SW[3:0]
F_SYSCLK
SW1
SW0
CLKIN1_N
CLKIN1_P
CLKOUT1_N
CLKOUT1_P
EGPIO[31:0]
CLKOUT1_P
CLKOUT1_N
CLKIN1_N
CLKIN1_P
DFFIO_CLK_IN_P1
DFFIO_CLK_IN_N1
DFFIO_CLK_OUT_P1
DFFIO_CLK_OUT_N1
DFFIOA_RX_N[11:0]
DFFIOA_TX_N[11:0]
DFFIOA_RX_P[11:0]
DFFIOA_TX_P[11:0]
F_SYSCLK
DFFIOA_RX_P0
DFFIOA_RX_P2
DFFIOA_RX_N1
DFFIOA_RX_N0
DFFIOA_RX_P1
DFFIOA_RX_P3
DFFIOA_RX_N2
DFFIOA_RX_N3
DFFIOA_RX_N4
DFFIOA_RX_P4
DFFIOA_RX_P5
DFFIOA_RX_N5
DFFIOA_RX_P6
DFFIOA_RX_N6
DFFIOA_RX_P7
DFFIOA_RX_N7
DFFIOA_RX_P8
DFFIOA_RX_N8
DFFIOA_RX_P9
DFFIOA_RX_N9
DFFIOA_RX_P10
DFFIOA_RX_N10
DFFIOA_RX_P11
DFFIOA_RX_N11
DFFIOA_TX_P0
DFFIOA_TX_N0
DFFIOA_TX_P1
DFFIOA_TX_N1
DFFIOA_TX_P2
DFFIOA_TX_N2
DFFIOA_TX_P3
DFFIOA_TX_N3
DFFIOA_TX_P4
DFFIOA_TX_N4
DFFIOA_TX_P5
DFFIOA_TX_N5
DFFIOA_TX_P6
DFFIOA_TX_N6
DFFIOA_TX_P7
DFFIOA_TX_N7
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DFFIOA_TX_N8
DFFIOA_TX_P9
DFFIOA_TX_N9
DFFIOA_TX_N10
DFFIOA_TX_P10
DFFIOA_TX_P11
DFFIOA_TX_N11
DFFIO_CLK_OUT_N1
DFFIO_CLK_OUT_P1
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EGPIO0
EGPIO1
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EGPIO12
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EGPIO29
EGPIO30
EGPIO31
RXDV
SW2
SW3
TXD0
MDC
RXD0
RXCLK
TXD2
TXD1
TXD3
COL
RXD3
TXCLK
CRS
RXD2
TXEN
MDIO
RXD1
RXDV
RXER
3.3V
3.3V
SW[3:0]
F_SYSCLK
CLKIN1_P
CLKOUT1_P
EGPIO[31:0]
CLKOUT1_N
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DFFIO_CLK_IN_P1
DFFIO_CLK_IN_N1
DFFIO_CLK_OUT_N1
DFFIO_CLK_OUT_P1
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DFFIOA_TX_P[11:0]
DFFIOA_TX_N[11:0]
DFFIOA_RX_P[11:0]
RXD0
RXCLK
TXD0
TXD1
MDC
TXD3
COL
TXD2
TXCLK
RXD2
TXEN
RXD3
RXD1
CRS
RXDV
RXER
MDIO
Title
Size Document Number Rev
Date: Sheet
of
01 FPGA_BANK01
V1.0
SMART
A4
29Wednesday, March 14, 2012
V3BEST
Title
Size Document Number Rev
Date: Sheet
of
01 FPGA_BANK01
V1.0
SMART
A4
29Wednesday, March 14, 2012
V3BEST
Title
Size Document Number Rev
Date: Sheet
of
01 FPGA_BANK01
V1.0
SMART
A4
29Wednesday, March 14, 2012
V3BEST
BANK0
U1A
XC6SLX09FTG256
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U1A
XC6SLX09FTG256
IO_L1N_VREF_0
A4
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B5
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D7
BANK1
U1B
XC6SLX09FTG256
BANK1
U1B
XC6SLX09FTG256
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E13
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H14
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J11
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