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门禁专业系统设计.docx
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门禁系统设计
设计内容:
门禁系统硬件设计;
门禁系统软件设计。
设计目标:
经过 技术,验证射频门禁卡正当性,控制电子
门锁开启;
门禁卡信息进行管理。
系统功效:
卡片使用模式:采取 非接触式物联网射频
卡;
刷卡开门:用户进入门禁管制区域时需刷卡,读卡器
读取信息后,将信息传输到主机,主机首先判定信息是否正
当,如正当则发出开门指令,不正当则发出报警,同时统计
用户刷卡事件;
管理控制;对控制器统计进行搜集管理,可增加、删
除、更新用户信息;
统计存放;系统可将门禁控制器运行产生全部用户刷
卡事件、报警时间等进行统计;
报警功效:如发生控制器异常、非法卡开门等事件时
系统发出报警信号。
门禁系统设计框图
继电器模块(模
拟门开)
刷卡模块
报警模块
非 接 触 式 IC
(蜂鸣器)
卡感应区域
按键模块
液晶 LCD12864
显示
电源供电
晶振、复位
电路
读卡器:读射频卡信息。
按键模块:注册通行卡。
按下设置键,把工作模式切换到注册模式后,刷卡并显示卡号自
动注册。注册完成后液晶显示注册完成。再次刷这张 卡时,就能
开门。
注销通行卡(清除存放器卡号数据)
按下设置键,把工作模式切换到注销模式后,刷卡并显示自动注
销,就把存放里保留卡号数据清除。清除数据后,卡已经处于注
销状态
一. 硬件设计内容(系统硬件电路图设计)
1.各模块选择硬件介绍
刷卡模块、单片机模块、继电器模块、按键模块和蜂鸣器模块组成。其用高
频读卡器模块 ,能读写荷兰 企业 非接触式射频卡,读卡
距离约 。控制模块采取 !"单片机,它含有 !#可编程 存放器。
单片机和读卡器通信是采取 通信。
1.1 STC89C52 单片机介绍
控制关键选择 !"。其关键性能以下:
!"单片机和 $单片机产品能够兼容
在系统内可编程 存放器 !#字节
擦写周期可达成 次
程序存放器可做到三级加密
可编程 %&口线数量达成 个
总共有三个 位计数器
中止源数目达成了 !个
!单片机含有全双工 '( 串行通道
"不开启是能耗低
停电以后中止可复位
()功效特征描述
该 !"单片机作为低功耗、高性能 &!位微控制器,系统可编程
存放器拥有 !#。利用 ()企业独特高密度难丢失存放器技术制造,和
工业 上 !产品说明能够和引脚完全兼容。单片机上 做到程序存放器
在系统中能够编程,大众化编程器也可进行编程。在单片机芯片上,有 !位 '
和在系统可编程 ,做到了 !"为众多嵌入式控制应用系统提供高灵
活、极为有效处理方案。
()引脚图以下:
图 1.1 STC89C52 引脚图
()引脚介绍:
*+接电源
,-+接地
口:口是一个 !位漏极开路双向 %&口。作为输出口,每位能驱动 !
个 .逻辑电平。对 端口写“/时,引脚用作高阻抗输入。 当访问外部程
序和数据存放器时, 口也被作为低 !位地址%数据复用。在这种模式下,
含有内部上拉电阻。 在 0编程时,口也用来接收指令字节;在程序校验
时,输出指令字节。程序校验时,需要外部上拉电阻。
口:口是一个含有内部上拉电阻 !位双向 %&口,输出缓冲器
能驱动 个 .逻辑电平。对 端口写“/时,内部上拉电阻把端口拉高,
此时能够作为输入口使用。作为输入使用时,被外部拉低引脚因为内部电阻原因,
将输出电流(.) 。另外,和 分别作定时器%计数器 外部计数输
入(% )和时器%计数器 触发输入(% 12) ,具体以下表所表示。
在 0编程和校
验时,口接收低 !位地址字节。
表 1.1 P0 口第二功效
第 2 功效
引脚
P1.0
P1.1
P1.5
P1.6
P1.7
T2(定时器/计数器 T2 外部计数输入) ,时钟输出
P1.1 T2EX(定时器/计数器 T2 捕捉/重载触发信号和方向控制)
MOSI(在系统编程用)
SCK(在系统编程用)
口:口是一个含有内部上拉电阻 !位双向 %&口,输出缓冲器
能驱动 个 .逻辑电平。对 端口写“/时,内部上拉电阻把端口拉高,
此时能够作为输入口使用。作为输入使用时,被外部拉低引脚因为内部电阻原因,
将输出电流(.) 。在访问外部程序存放器或用 位地址读取外部数据存放
器 (比如实施 &*23 )时,口送出高八位地址。在这种应用中,口
使用很强内部上拉发送 。在使用 !位地址(如 &*23)访问外部数据存放
器时,口输出 锁存器内容。 在 0编程和校验时,口也接收高 !位
地址字节和部分控制信号。
口:口是一个含有内部上拉电阻 !位双向 %&口,输出缓冲器
能驱动 个 .逻辑电平。对 端口写“/时,内部上拉电阻把端口拉高,
此时能够作为输入口使用。作为输入使用时,被外部拉低引脚因为内部电阻原因,
将输出电流(.) 。口亦作为 ( !"特殊功效(第二功效)使用,以下
表所表示。在 0编程和校验时,口也接收部分控制信号。
表 1.2 P3 口第二功效
引脚
2 4串行口输入端5
2 (串行口输出端)
INT0 (外部中止 请求输入端,低电平有效)
INT1 (外部中止 请求输入端,低电平有效)
表 1.3 P3 口第二功效
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