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第1关-单周期CPU(24条指令)-35614475.txt
第1关-单周期CPU(24条指令)-35614475.txt
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第1关-单周期CPU(24条指令)-35614475.txt
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24条指令cpu+mips单周期+多周期微程序.rar
包含华科计组实验 8条指令单周期cpu和多周期微程序地址转移，在同一个.circ文件中 包含24条指令cpu的.circ和excel的控制信号表，还有多周期微程序地址转移excel表。 还有相关的.jar等相关文件 以及包含24条指令cpu的.circ和excel的控制信号表，还有多周期微程序地址转移excel表的课程设计文档
华中科技大学计算机组成原理--24条指令MIPS单周期CPU
5星 · 资源好评率100%
华中科技大学计算机组成原理，头歌实践平台上的24条指令MIPS单周期CPU实验包
24条指令MIPS单周期CPU课程设计报告完整版.docx
5星 · 资源好评率100%
24条指令MIPS单周期CPU课程设计报告完整版
24条指令MIPS单周期CPU源文件等资源.zip
5星 · 资源好评率100%
24条指令MIPS单周期CPU课设设计有这个压缩包足够
Verilog 语言设计单周期MIPS CPU（42条指令）
实验内容（ISA2新增3条指令） • 用硬件描述语言（Verilog）设计MIPS CPU，支持如下指令集 • ISA1 = {ADD/ADDU/SUB/SUBU/SLL/SRL/SRA/SLLV/SRLV/SRAV/AND/OR/XOR/NOR/ SLT/SLTU/ADDI/ADDIU/ANDI/ORI/XORI/LUI/SLTI/SLTIU/LB/LBU/LH/LH U/LW/SB/SH/SW
计组头歌实验：MIPS单周期CPU设计(24条指令)(HUST)1-4关源码
5星 · 资源好评率100%
码上即通过，快来试试！
MIPS单周期CPU-组成原理实验-华中科技大学
4星 · 用户满意度95%
使用logisim布线完成的MIPS单周期CPU，可支持28条指令。跑马灯的代码已经装入了寄存器，可以直接开启时钟运行。
单周期CPU指令数据通路
MIPS指令集的本文档为一份单周期CPU的指令数据通路，内部部件连线，包括三种指令的数据通路
24条指令cpu+分支流水线实验(完整).circ
5星 · 资源好评率100%
此资源在多方大佬的协助下完成的，看网上几乎没有关于24条单周期指令的电路设计图还有分支流水的电路图，于是贡献出来跟大家一起分享，因为是有偿的，所以就设定了积分，便于以后能够发更好的资源给大家分享~谢谢了
单周期24条指令.zip
单周期CPU设计实验我们首先设计一个硬布线控制器，利用硬布线控制器的设计原理，来实现一个支持24条指令的MIPS单周期CPU。利用在运算器实验和存储系统实验中构建的运算器、寄存器文件、存储系统等部件以及Logisim...
头歌educoder教学实践平台计算机组成原理单总线CPU设计(定长指令周期3级时序)(HUST).zip
5星 · 资源好评率100%
第1关—第6关，源代码txt格式。 第1关 MIPS指令译码器设计 第2关 定长指令周期---时序发生器FSM设计 第3关 定长指令周期---时序发生器输出函数设计 第4关 硬布线控制器组合逻辑单元 第5关 定长指令周期---硬布线控制...
计算机组成原理 头歌平台实验 单总线CPU设计源码(定长指令周期3级时序)(HUST).zip
5星 · 资源好评率100%
本实训项目帮助学生理解定长指令周期三级时序系统的设计，能利用该时序构造硬布线控制器，支持5条典型MIPS指令在单总线CPU上运行，最终CPU能运行内存冒泡排序。 第1关MIPS指令译码器设计 第2关定长指令周期---时序...
8指令单周期MIPS CPU设计
5星 · 资源好评率100%
8指令单周期MIPS CPU设计 1、单周期硬布线控制器 2、单周期 MIPS（硬布线）
计组大作业-minisys单周期CPU
本资源包含了计算机组成原理课程最后的课程设计的所有相关资源、代码、PPT以及实验报告。其中包含了minisys的工程文件，打开即可看到，本课设还包含了外设的使用，也录制了相关使用外设的演示视频如蜂鸣器（音节和救护车声音）、七段数码管、数码管时钟等
FPGA单周期MIPS指令集CPU
这是一个基于MIPS指令集的单周期CPU涉及代码，设计思路和通路图均在博客中，欢迎阅读
头歌实践教学平台 MIPS CPU设计(HUST)
5星 · 资源好评率100%
第1关：单周期MIPS CPU设计.txt 第2关：微程序地址转移逻辑设计.txt 第3关：MIPS微程序CPU设计.txt 第4关：硬布线控制器状态机设计.txt 第5关：多周期MIPS硬布线控制器CPU设计（排序程序）.txt 存储器第七关.txt ...
华科计算机组成原理 头歌Educoder Logisim MIPS单周期CPU设计(24条指令)(HUST)
5星 · 资源好评率100%
仅是通过头歌测试的完成文件（cpu24.circ）第一关：单周期CPU(24条指令)通过测试，无其他内容~ 学习交流q2267261634
华科计算机组成原理 头歌Educoder Logisim 单总线CPU设计(定长指令周期3级时序)(HUST）1~6关满分通关
MIPS指令译码器设计|定长指令周期---时序发生器FSM设计|定长指令周期---时序发生器输出函数设计|硬布线控制器组合逻辑单元|定长指令周期---硬布线控制器设计|定长指令周期---单总线CPU设计 学习交流q2267261634
Educode单总线CPU设计实验(定长指令周期3级时序)(HUST)
5星 · 资源好评率100%
1 MIPS指令译码器设计 2 定长指令周期---时序发生器FSM设计 3 定长指令周期---时序发生器输出函数设计 4 硬布线控制器组合逻辑...6 定长指令周期---单总线CPU设计 全通关（放入logisim可查看电路，改成txt可上传代码）
计组头歌实验：单总线CPU设计(变长指令周期3级时序)(HUST)1-6关源码
5星 · 资源好评率100%
码上即通关，快来试试！
基于MIPS32的单周期CPU的设计与实现.zip
基于vivado软件，使用verilog语言，较好地实现MIPS32的20条指令。包含测试代码和CPU实现代码。 实现的具体功能如下： 1.设计的CPU能够执行20条整数指令，每条指令的编码长度均为32位； 2.指令类型有：计算类型、访问存储器类型、条件转移类型和无条件转移类型等； 3.实现CPU的封装处理。 具体设计思路参见：https://blog.csdn.net/qq_45288
计算机组成头歌单总线CPU设计(定长指令周期3级时序)实验1-6关全部满分代码
5星 · 资源好评率100%
计算机组成头歌单总线CPU设计(定长指令周期3级时序)实验1-6关全部满分代码
单总线CPU设计(定长指令周期3级时序)(HUST)通关全码
5星 · 资源好评率100%
本实训项目帮助学生理解定长指令周期三级时序系统的设计，能利用该时序构造硬布线控制器，支持5条典型MIPS指令在单总线CPU上运行，最终CPU能运行内存冒泡排序。 第1关MIPS指令译码器设计 第2关定长指令周期---时序...
计组单周期CPU设计.zip
根据袁春风老师编写的《计算机组成与系统结构第二版》的课程材料，完成的计组单周期CPU设计，已经完成简单测试。包括五条R型指令（add，sub,subu,slt,sltu）,五条I型指令(addu,beq,ori,lw,sw),和一条J型指令（jump）...
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