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G474Datasheet

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November 2020 RM0440 Rev 5 1/2128

RM0440

Reference manual

STM32G4 Series

advanced Arm

-based 32-bit MCUs

Introduction

This reference manual targets application developers. It provides complete information on

how to use the STM32G4 Series microcontroller memory and peripherals.

The STM32G4 Series is a family of microcontrollers with different memory sizes, packages

and peripherals.

For ordering information, mechanical and electrical device characteristics refer to the

corresponding datasheets.

For information on the Arm

Cortex

-M4 core, refer to the Cortex

-M4 Technical Reference

Manual.

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-M4 programming manual

(PM0214)

www.st.com

Contents RM0440

2/2128 RM0440 Rev 5

Contents

1 Documentation conventions . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73

1.1 General information . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73

1.2 List of abbreviations for registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 73

1.3 Glossary . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74

1.4 Product category definition . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74

1.5 Availability of peripherals . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 74

2 System and memory overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78

2.1 System architecture . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 78

2.1.1 I-bus . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 79

2.1.2 D-bus . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 79

2.1.3 S-bus . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 80

2.1.4 DMA-bus . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 80

2.1.5 BusMatrix . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 80

2.2 Memory organization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 81

2.2.1 Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 81

2.2.2 Memory map and register boundary addresses . . . . . . . . . . . . . . . . . . 82

2.3 Bit banding . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 86

2.4 Embedded SRAM . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 87

2.4.1 Parity check . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 88

2.4.2 CCM SRAM Write protection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 88

2.4.3 CCM SRAM read protection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 89

2.4.4 CCM SRAM erase . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 89

2.5 Flash memory overview . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 90

2.6 Boot configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 90

2.6.1 Boot configuration . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 90

3 Embedded Flash memory (FLASH)

for category 3 devices . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 93

3.1 Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 93

3.2 FLASH main features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 93

3.3 FLASH functional description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 94

3.3.1 Flash memory organization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 94

RM0440 Rev 5 3/2128

RM0440 Contents

3.3.2 Error code correction (ECC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 96

3.3.3 Read access latency . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 97

3.3.4 Adaptive real-time memory accelerator (ART Accelerator) . . . . . . . . . . 99

3.3.5 Flash program and erase operations . . . . . . . . . . . . . . . . . . . . . . . . . . 101

3.3.6 Flash main memory erase sequences . . . . . . . . . . . . . . . . . . . . . . . . . 102

3.3.7 Flash main memory programming sequences . . . . . . . . . . . . . . . . . . . 103

3.3.8 Read-while-write (RWW) available only in dual bank mode

(DBANK=1) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 107

3.4 FLASH option bytes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109

3.4.1 Option bytes description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 109

3.4.2 Option bytes programming . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 117

3.5 FLASH memory protection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 120

3.5.1 Read protection (RDP) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 120

3.5.2 Proprietary code readout protection (PCROP) . . . . . . . . . . . . . . . . . . 123

3.5.3 Write protection (WRP) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 125

3.5.4 Securable memory area . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 126

3.5.5 Disabling core debug access . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 126

3.5.6 Forcing boot from Flash memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 127

3.6 FLASH interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 127

3.7 FLASH registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 128

3.7.1 Flash access control register (FLASH_ACR) . . . . . . . . . . . . . . . . . . . 128

3.7.2 Flash Power-down key register (FLASH_PDKEYR) . . . . . . . . . . . . . . 129

3.7.3 Flash key register (FLASH_KEYR) . . . . . . . . . . . . . . . . . . . . . . . . . . . 130

3.7.4 Flash option key register (FLASH_OPTKEYR) . . . . . . . . . . . . . . . . . . 130

3.7.5 Flash status register (FLASH_SR) . . . . . . . . . . . . . . . . . . . . . . . . . . . 131

3.7.6 Flash control register (FLASH_CR) . . . . . . . . . . . . . . . . . . . . . . . . . . . 133

3.7.7 Flash ECC register (FLASH_ECCR) . . . . . . . . . . . . . . . . . . . . . . . . . . 135

3.7.8 Flash option register (FLASH_OPTR) . . . . . . . . . . . . . . . . . . . . . . . . . 137

3.7.9 Flash PCROP1 Start address register (FLASH_PCROP1SR) . . . . . . 139

3.7.10 Flash PCROP1 End address register (FLASH_PCROP1ER) . . . . . . . 140

3.7.11 Flash Bank 1 WRP area A address register (FLASH_WRP1AR) . . . . 141

3.7.12 Flash Bank 1 WRP area B address register (FLASH_WRP1BR) . . . . 141

3.7.13 Flash PCROP2 Start address register (FLASH_PCROP2SR) . . . . . . 142

3.7.14 Flash PCROP2 End address register (FLASH_PCROP2ER) . . . . . . . 142

3.7.15 Flash Bank 2 WRP area A address register (FLASH_WRP2AR) . . . . 143

3.7.16 Flash Bank 2 WRP area B address register (FLASH_WRP2BR) . . . . 144

3.7.17 Flash Securable area bank1 register (FLASH_SEC1R) . . . . . . . . . . . 144

Contents RM0440

4/2128 RM0440 Rev 5

3.7.18 Flash Securable area bank2 register (FLASH_SEC2R) . . . . . . . . . . . 145

3.7.19 FLASH register map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 146

4 Embedded Flash memory (FLASH)

for category 4 devices . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 148

4.1 Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 148

4.2 FLASH main features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 148

4.3 FLASH functional description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 149

4.3.1 Flash memory organization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 149

4.3.2 Error code correction (ECC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 150

4.3.3 Read access latency . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 150

4.3.4 Adaptive real-time memory accelerator (ART Accelerator) . . . . . . . . . 151

4.3.5 Flash program and erase operations . . . . . . . . . . . . . . . . . . . . . . . . . . 154

4.3.6 Flash main memory erase sequences . . . . . . . . . . . . . . . . . . . . . . . . . 155

4.3.7 Flash main memory programming sequences . . . . . . . . . . . . . . . . . . . 156

4.4 FLASH option bytes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 160

4.4.1 Option bytes description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 160

4.4.2 Option bytes programming . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 164

4.5 FLASH memory protection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 166

4.5.1 Read protection (RDP) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 166

4.5.2 Proprietary code readout protection (PCROP) . . . . . . . . . . . . . . . . . . 169

4.5.3 Write protection (WRP) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 170

4.5.4 Securable memory area . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 171

4.5.5 Disabling core debug access . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 172

4.5.6 Forcing boot from Flash memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 172

4.6 FLASH interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 173

4.7 FLASH registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 174

4.7.1 Flash access control register (FLASH_ACR) . . . . . . . . . . . . . . . . . . . 174

4.7.2 Flash Power-down key register (FLASH_PDKEYR) . . . . . . . . . . . . . . 175

4.7.3 Flash key register (FLASH_KEYR) . . . . . . . . . . . . . . . . . . . . . . . . . . . 176

4.7.4 Flash option key register (FLASH_OPTKEYR) . . . . . . . . . . . . . . . . . . 176

4.7.5 Flash status register (FLASH_SR) . . . . . . . . . . . . . . . . . . . . . . . . . . . 177

4.7.6 Flash control register (FLASH_CR) . . . . . . . . . . . . . . . . . . . . . . . . . . . 178

4.7.7 Flash ECC register (FLASH_ECCR) . . . . . . . . . . . . . . . . . . . . . . . . . . 180

4.7.8 Flash option register (FLASH_OPTR) . . . . . . . . . . . . . . . . . . . . . . . . . 181

4.7.9 Flash PCROP1 Start address register (FLASH_PCROP1SR) . . . . . . 183

RM0440 Rev 5 5/2128

RM0440 Contents

4.7.10 Flash PCROP1 End address register (FLASH_PCROP1ER) . . . . . . . 184

4.7.11 Flash WRP area A address register (FLASH_WRP1AR) . . . . . . . . . . 184

4.7.12 Flash WRP area B address register (FLASH_WRP1BR) . . . . . . . . . . 185

4.7.13 Flash Securable area register (FLASH_SEC1R) . . . . . . . . . . . . . . . . . 185

4.7.14 FLASH register map . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 187

5 Embedded Flash memory (FLASH)

for category 2 devices . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 189

5.1 Introduction . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 189

5.2 FLASH main features . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 189

5.3 FLASH functional description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 190

5.3.1 Flash memory organization . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 190

5.3.2 Error code correction (ECC) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 191

5.3.3 Read access latency . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 191

5.3.4 Adaptive real-time memory accelerator (ART Accelerator) . . . . . . . . . 192

5.3.5 Flash program and erase operations . . . . . . . . . . . . . . . . . . . . . . . . . . 195

5.3.6 Flash main memory erase sequences . . . . . . . . . . . . . . . . . . . . . . . . . 196

5.3.7 Flash main memory programming sequences . . . . . . . . . . . . . . . . . . . 197

5.4 FLASH option bytes . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 201

5.4.1 Option bytes description . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 201

5.4.2 Option bytes programming . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 205

5.5 FLASH memory protection . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 207

5.5.1 Read protection (RDP) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 207

5.5.2 Proprietary code readout protection (PCROP) . . . . . . . . . . . . . . . . . . 210

5.5.3 Write protection (WRP) . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 211

5.5.4 Securable memory area . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 212

5.5.5 Disabling core debug access . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 213

5.5.6 Forcing boot from Flash memory . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 213

5.6 FLASH interrupts . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 214

5.7 FLASH registers . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . 215

5.7.1 Flash access control register (FLASH_ACR) . . . . . . . . . . . . . . . . . . . 215

5.7.2 Flash Power-down key register (FLASH_PDKEYR) . . . . . . . . . . . . . . 216

5.7.3 Flash key register (FLASH_KEYR) . . . . . . . . . . . . . . . . . . . . . . . . . . . 217

5.7.4 Flash option key register (FLASH_OPTKEYR) . . . . . . . . . . . . . . . . . . 217

5.7.5 Flash status register (FLASH_SR) . . . . . . . . . . . . . . . . . . . . . . . . . . . 218

5.7.6 Flash control register (FLASH_CR) . . . . . . . . . . . . . . . . . . . . . . . . . . . 219

剩余2127页未读，继续阅读

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