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verilog编写的FIFO

共5个文件

v：5个

verilog

FIFO

需积分: 9 39 下载量 17 浏览量 2010-03-13 15:11:16 上传评论收藏 2KB RAR 举报

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数字信号处理中经常使用到FIFO存储器，本程序就是用verilog语言编写的FIFO存储器，将每个模块分开，层次清晰。

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FIFO设计.rar （5个子文件）

FIFO设计

async_cmp.v 703B

wptr_full.v 832B

dp_ram.v 516B

rptr_empty.v 799B

async_fifo.v 1KB

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