XAPP501 (v1.4) 2003 年 7 月 24 日 www.xilinx.com/cn 1
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提要 本应用指南讨论 Xilinx 的复杂可编程逻辑器件 (CPLD)、现场可编程门阵列 (FPGA) 和 PROM 系
列的配置与编程选项，并演示了各系列最常用的部分配置方法。
简介 为满足系统设计人员的不同要求，我们提供了多种 Xilinx FPGA 配置方法以及 CPLD 和 PROM
编程方法。本技术文档讲述了不同的配置模式，以期协助设计人员选择恰当的配置或编程方
法。我们举例说明部分最常用的方法，这些方法可用于生产和原型开发。
配置 Xilinx 可编程逻辑器件或为其编程需要以下三个常规步骤。有关详情，请参阅 Xilinx 软件
手册。
• 步骤 1 － 设计输入
用软件设计输入工具以 VHDL、Verilog、ABEL 或 Schematic （原理图）创建设计。
• 步骤 2 － 实现
用软件实现工具将设计网表导入所需的 Xilinx 架构，并且生成配置比特流或 JEDEC 文件。
• 步骤 3 － 配置或编程
配置是用外部数据源 （如 PROM、CPLD 或微处理器）将配置数据下载到 FPGA 中的过
程。
编程是将配置数据或程序数据载入 CPLD 或 PROM 的过程。请见图1。
器件定义
Xilinx 生产三种可编程逻辑器件。以下简要说明这些产品类型，以帮助设计人员了解各类型所
需的配置：
应用指南： Xilinx 系列
XAPP501 (v1.4) 2003 年 7 月 24 日
配置快速入门指南
作者： Stephanie Tapp
R
图 1:
配置与编程流程概览
Design Entry
(VHDL, Verilog, ABEL,
or Schematic)
Implementation
(Fitting to Device
Architecture)
Configuration or
Programming
Step 2
Step 1
Step 3
x501_01_010901
EDIF Netlist
Bitstream (.bit),
jedec file (.jed),
or PROM file
(.mcs, .exo, .tek)
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