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运算器设计包括六关 :8位可控加减法电路设计,CLA182四位先行进位电路设计,4位快速加法器设计16位快速加法器设计,原码一位乘法器设计,MIPS运算器设计 存储系统包括五关:MIPS寄存器文件设计,MIPS RAM设计,全相联cache设计,直接相联cache设计,2路组相联cache设计 单总线CPU包括六关:MIPS指令译码器设计,定长指令周期---时序发生器FSM设计,时序发生器输出函数设计,硬布线控制器组合逻辑单元,硬布线控制器设计,单总线CPU设计
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ctgu20-acm-律
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