REM
REM Vivado(TM)
REM htr.txt: a Vivado-generated description of how-to-repeat the
REM the basic steps of a run. Note that runme.bat/sh needs
REM to be invoked for Vivado to track run status.
REM Copyright 1986-2016 Xilinx, Inc. All Rights Reserved.
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vivado -log MainProfessor.vdi -applog -m64 -messageDb vivado.pb -mode batch -source MainProfessor.tcl -notrace
远程无线电子钢琴（基于Basys 3 FPGA开发板） （194个子文件） 
runme.bat 229B runme.bat 229B runme.bat 229B runme.bat 229B MainProfessor.bit 2.09MB piano_tx_b3.bit 2.09MB MainStudent.bit 2.09MB piano_rx_b3.bit 2.09MB MainProfessor_routed.dcp 424KB MainProfessor_placed.dcp 358KB MainProfessor_opt.dcp 261KB MainStudent_routed.dcp 188KB MainProfessor.dcp 169KB MainStudent_placed.dcp 149KB MainStudent_opt.dcp 142KB MainStudent.dcp 37KB
usage_statistics_webtalk.html 25KB usage_statistics_ext_labtool.html 3KB .xsim_webtallk.info 59B vivado.jou 834B vivado.jou 829B vivado_8008.backup.jou 597B vivado_1248.backup.jou 597B vivado_6396.backup.jou 528B vivado.jou 513B vivado.jou 502B vivado.jou 495B ISEWrap.js 7KB ISEWrap.js 7KB ISEWrap.js 5KB ISEWrap.js 5KB rundef.js 1KB rundef.js 1KB rundef.js 1KB rundef.js 1KB runme.log 54KB runme.log 40KB runme.log 22KB runme.log 21KB vivado_6396.backup.log 584B vivado.log 569B labtool_webtalk.log 412B Basys3_rx.lpr 343B Basys3_tx_usb.lpr 343B fsm_encoding.os 2KB vivado.pb 88KB vivado.pb 62KB place_design.pb 16KB place_design.pb 15KB route_design.pb 11KB route_design.pb 10KB opt_design.pb 5KB opt_design.pb 5KB write_bitstream.pb 4KB init_design.pb 3KB write_bitstream.pb 2KB init_design.pb 2KB MainProfessor_power_summary_routed.pb 740B MainStudent_power_summary_routed.pb 693B MainProfessor_utilization_synth.pb 249B MainProfessor_utilization_placed.pb 249B MainStudent_utilization_synth.pb 231B MainStudent_utilization_placed.pb 231B vivado.pb 149B vivado.pb 129B MainStudent_timing_summary_routed.pb 109B MainStudent_route_status.pb 44B MainProfessor_route_status.pb 44B MainStudent_drc_routed.pb 37B MainProfessor_drc_routed.pb 37B MainProfessor_1248.backup.rdi 20KB MainProfessor_timing_summary_routed.rpt 263KB MainProfessor_io_placed.rpt 60KB MainStudent_io_placed.rpt 57KB MainStudent_timing_summary_routed.rpt 31KB MainProfessor_clock_utilization_routed.rpt 15KB MainProfessor_control_sets_placed.rpt 11KB MainStudent_clock_utilization_placed.rpt 11KB MainProfessor_utilization_placed.rpt 9KB MainProfessor_power_routed.rpt 8KB MainStudent_utilization_placed.rpt 8KB MainStudent_power_routed.rpt 8KB MainProfessor_utilization_synth.rpt 7KB MainStudent_control_sets_placed.rpt 7KB MainStudent_utilization_synth.rpt 6KB MainStudent_drc_routed.rpt 4KB MainProfessor_drc_routed.rpt 3KB MainProfessor_drc_opted.rpt 3KB MainStudent_route_status.rpt 588B MainProfessor_route_status.rpt 588B MainProfessor_power_routed.rpx 281KB MainProfessor_timing_summary_routed.rpx 210KB .write_bitstream.begin.rst 175B .init_design.begin.rst 175B .place_design.begin.rst 175B .opt_design.begin.rst 175B .route_design.begin.rst 175B .vivado.begin.rst 174B .vivado.begin.rst 174B .write_bitstream.begin.rst 168B共 194 条
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LEEE@FPGA
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