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电子设计竞赛资料_电源类_开关电源PCB_LAYOUT原则.pdf
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电子设计竞赛资料_电源类_开关电源PCB_LAYOUT原则.pdf
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编 码
电源技术有限公司
版 本
V01
文件名称
PCB layout 作业指导书
页 码
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※ 本文件之著作权属于电源技术有限公司,未经允许不得翻印 ※
1.0 目的
规范 PCB 的设计思路,保证和提高 PCB 的设计质量。
2.0 适用范围
适用于 PCB Layout.
3.0 职责
PCB 工程师:负责 PCB layout 工作
4.0 规定
4.1:Layout 部分…………………………………………………………2-19
4.2:工艺处理部分………………………………………………………20-23
4.3:检查部分……………………………………………………………24-25
4.4:安规作业部分………………………………………………………26-32
4
4
.
.
1
1
L
L
a
a
y
y
o
o
u
u
t
t
部
部
分
分
4.1.1 长线路抗干扰
如:图二
图一 图二
在图二中,PCB 布局时,驱动电阻 R3 应靠近 Q1(MOS 管),电流取样电阻 R4 应靠近 U1 的第 3Pin,
高阻
低阻
R
R
D
D
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即上图一所说的 R、D 应尽量缩短高阻抗线路。又因运算放大器输入端阻抗很高,易受干扰。输出
端阻抗较低,不易受干扰。一条长线相当于一根接收天线,容易引入外界干扰。
又如图三:
(A)
(B)
在图三的 A 中排版时,R1、R2 要靠近三极管 Q1 放置,因 Q1 的输入阻抗很高,基极线路过长,
易受干扰,则 R1、R2 不能远离 Q1。
在图三的 B 中排版时,C2 要靠近 D1,因为 Q3 三极管输入阻抗很高,如 Q2 至 D1 的线路太长,
易受干扰,则 C2 应移至 D1 附近。
4.1.2、小信号走线尽量远离大电流走线,忌平行。
4.1.3、小信号处理电路布线尽量集中,减少布板面积提高抗干扰能力。
4.1.4、一个电流回路走线尽可能减少包围面积。
电路一
电路二
电路二
电路一
Q3
Q3
大
小信号线
大电流走线
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如:电流取样信号线和来自光耦的信号线
4.1.5、光电耦合器件,易受干扰,应远离强电场、强磁场器件,如大电流走线、变压器、高电位
脉动器件等。
4.1.6、多个 IC 等供电,Vcc、地线注意。
并联单点接地,互不干扰。
串联多点接地,相互干扰
4.1.7、弱信号走线,不要在棒形电感、电流环等器件下走线。
如以前 SU450,电流取样线在批量生产时发生磁芯与线路铜箔相碰,造成故障。
4.1.7.1 噪声要求
4.1.7.1.1、尽量缩小由高频脉冲电流所包围的面积,如下(图一、图二)
信号线
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电路
管
入口
管
电路
图一
一般布板方式:
散热器
图二
4.1.7.1.2、滤波电容尽量贴近开关管或整流二极管如上图二,C1 尽量靠近 Q1,C3 靠近 D1 等
4.1.7.1.3、脉冲电流流过的区域远离输入、输出端子,使噪声源和输入、输出口分离,如 A105。
图三
图三:MOS 管、变压器离入口太近,EMI 传导通不过。
图四
电路
管
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图四:MOS 管、变压器远离入口,EMI 传导能通过。
4.1.7.1.4、控制回路与功率回路分开,采用单点接地方式,如图五。
图五
1、3842、3843、2843、2842IC 周
围的元件接地接至 IC 的地脚
(第 5 脚);再从第 5 脚引出至大
电容地线。
2 光 耦 第 3 脚 地 接 到 IC 的 第 2
脚,第 2 脚接至 IC 的 5 脚上。
图六
4.1.7.1.5、必要时可以将输出滤波电感安置在地回路上。
4.1.7.1.6、用多只 ESR 低的电容并联滤波。
4.1.7.1.7、用铜箔进行低感、低阻配线,相邻之间不应有过长的平行线,走线尽量避免平行、交
叉用垂直方式,线宽不要突变,走线不要突然拐角(即:≤直角)。
4.1.7.2、抗干扰要求
地
T
控制部
光
耦
GND
功率部分
+
+
1
2
4
3
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阿拉伯梳子
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