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  • 同步六进制加法计数电路(D).zip

    本电路实现了同步六进制加法计数器的功能. 本电路的设计是为了给电子时钟模型的设计提供计数支持. 读者应仔细体会设计过程, 以进一步掌握同步时序逻辑电路的设计方法.

    2019-11-13
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  • 电子表(时 分 秒)模型.zip

    该电路以同步十进制加法计数电路、同步六进制加法计数器电路和同步十二进制加法计数电路为基础, 辅以十二进制转小时显示的译码电路, 最终构成了基本的电子表. 但用multisim7仿真运行时, 发现在数码管数字跳变的时刻显示不稳, 这可能与"竞争与冒险"现象有关. 日后我会继续研究这一部分的内容, 并继续修改这一模型.

    2019-11-13
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  • 同步十二进制加法计数器.zip

    本电路实现了同步十二进制加法计数器的功能. 该电路的设计是为了给电子钟模型电路提供技术支持, 初学同步时序逻辑电路的朋友应仔细推敲该例的设计, 以更快地掌握同步时序逻辑电路地设计方法.

    2019-11-13
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  • 同步六十进制加法计数器.zip

    本电路用同步十进制加法计数电路和同步六进制加法计数器电路的有机组合, 实现了六十进制加法计数器的功能. 通过该例子的设计, 可对同步N进制加法计数器输出Y的设定有进一步的认识.

    2019-11-12
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  • 同步五进制减法计数器.ms7

    本电路实现了同步五进制减法计数器的功能: 电路能准确地按照五进制减法计数的规律进行计数. 读者应深刻理解本例的分析和设计过程, 以为日后设计更为复杂的同步时序逻辑电路打下基础.

    2019-11-12
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  • 同步四进制加法计数器(JK).ms7

    本电路实现了同步四进制加法计数器的功能: 电路能准确地按照四进制加法计数的规律进行计数. 读者应深刻理解本例的分析和设计过程, 以为日后设计更为复杂的同步时序逻辑电路打下基础.

    2019-11-12
    8
  • 同步十六进制加法计数器.ms7

    本电路实现了同步十六进制加法计数器的功能: 电路能准确地按照十六进制加法计数的规律进行计数. 读者应深刻理解本例的分析和设计过程, 以为日后设计更为复杂的同步时序逻辑电路打下基础.

    2019-11-12
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  • 同步十进制加法计数器(JK).ms7

    本电路实现了同步十进制加法计数器的功能: 电路能准确地按照十进制加法计数的规律进行计数. 读者应深刻理解本例的分析和设计过程, 以为日后设计更为复杂的同步时序逻辑电路打下基础.

    2019-11-12
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  • 同步十进制加法计数器(D).ms7

    本电路实现了同步十进制加法计数器的功能: 电路能准确地按照十进制加法计数的规律进行计数. 读者应深刻理解本例的分析和设计过程, 以为日后设计更为复杂的同步时序逻辑电路打下基础.

    2019-11-12
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  • 同步三十二进制加法计数器.ms7

    本电路实现了同步三十二进制加法计数器的功能: 电路能准确地按照三十二进制加法计数的规律进行计数. 读者应深刻理解本例的分析和设计过程, 以为日后设计更为复杂的同步时序逻辑电路打下基础.

    2019-11-12
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