文档讲解了在FPGA中,遇到多时钟情况下,如何进行设计。
FPGA 多时钟
Verilog HDL的10道练习题目,能够弄明白,做出来,就可以做一些小工程了!
Verilog
讲解了异步FIFO处理数据时,如何估算FIFO的深度。讲的非常浅显易懂
数字电路 HDL FPGA
这是一个很有用的PDF密码解除工具,简单易用,使对加密的PDF文档进行复制、加注释等操作不再是难事!
解除PDF密码限制
可以有效的解除PDF文档的密码受限问题,复制,加注释,加下划线等操作不再是问题
解除PDF密码受限
VHDL与Verilog相互转换工具,内附注册文件
VHDL Verilog 转换工具
该Verilog程序讲解了在FPGA设计中,如何消除按键抖动,并用不同的按键驱动不同的LED的情况
FPGA 按键抖动
利用Jakes信道模型对通信的衰落信道进行建模!
Jakes信道模型
通信中的多径衰落影响较大,改程序有助于深刻理解该部分知识
多径衰落问题
有关多径延时的源程序,可以深入理解通信中的多径问题!
多径延时