数字跑表

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数字跑表

: EDA课程设计数字跑表.doc EDA课程设计数字跑表
评级：0 浏览量：737 收藏量：3 资源大小：2MB 上传时间：2022-05-04

: verilog设计数字跑表 verilog设计数字跑表
评级：0 浏览量：145 收藏量：0 资源大小：413KB 上传时间：2023-04-14

: 基于VHDL语言的数字跑表（ISE软件）此代码采用VHDL语言在ISE软件上实现了数字跑表的功能，内部包含分频模块，级联计数模块，使能模块和七段译码模块等等。
评级：0 浏览量：277 收藏量：0 资源大小：1.99MB 上传时间：2019-04-14

: FPGA数字跑表设计 FPGA数字跑表设计，内附项目设计分析报告+Verilog HDL代码+仿真结果，可直接烧写于FPGA中，适用于FPGA的初学者使用！
评级：0 浏览量：820 收藏量：7 资源大小：132KB 上传时间：2020-06-29

: 课程设计-verilog设计数字跑表.docx 题目：第15题：数字跑表 要求： 1．具有暂停/启动功能； 2．具有重新开始功能； 3．用6个数码管分别显示百分秒、秒和分钟。 Solution：根据要求，采用自底向上的设计方法：（本来是打算用ise和modelsim做的，但是...
评级：5 浏览量：1107 收藏量：3 资源大小：302KB 上传时间：2022-03-29

: paobiao.rar_数字跑表该程序是用verilog语言实现的数字跑表功能，其中分为计数模块与数码管显示模块。
评级：0 浏览量：35 收藏量：0 资源大小：1KB 上传时间：2022-09-22

: 数字跑表 秒表利用黑金开发板开发数字秒表系统，实现以下功能：（1）建议使用数码管、按键和按键；（2）实现秒表功能，在数码管上能实现秒的定时功能，范围为0-59秒；（3）上电后，秒表处于初始复位状态，显示值为“00”；（4...
评级：0 浏览量：153 收藏量：0 资源大小：41KB 上传时间：2018-12-09

: 数字跑表论文根据设计要求，首先对数字跑表进行结构和功能的划分。计数器部分设三个输入端，分为时钟启动，暂停，复位按键以及单片机的重启键。启动，暂停，复位键都是低电平有效，开始三个键都置空，接通电源，开始运行显示...
评级：0 浏览量：186 收藏量：2 资源大小：534KB 上传时间：2011-12-17

: 数字跑表程序用verilog写的数字跑表程序，程序简洁易懂，适合初学者学习
评级：0 浏览量：227 收藏量：1 资源大小：6KB 上传时间：2013-01-15

: 数字跑表计时器 vhdl语言实现数字跑表，可计时一个小时。
评级：0 浏览量：160 收藏量：0 资源大小：648KB 上传时间：2013-10-15

: EDA数字跑表用Verilog语言编写程序，实现数字跑表启动，暂停，计数功能
评级：0 浏览量：227 收藏量：0 资源大小：130KB 上传时间：2011-12-11

: 数字跑表设计数字集成电路使用Verilog HDL编写数字跑表程序
评级：2 浏览量：403 收藏量：0 资源大小：330KB 上传时间：2014-06-25

: 数字跑表逻辑电路的实现资源合集 数字跑表作为一个简易的数字集成电路的应用，被广泛应用在田径、游泳等体育项目中，在学校体育教学中也是必备的用具。数字跑秒使用简单，携带方便，在多种电气设备均有应用。数字跑表具有计时功能，本次设计的数字...
评级：0 浏览量：48 收藏量：0 资源大小：2.13MB 上传时间：2023-05-25

: number_clock.zip_FPGA 数字跑表 典型实例用FPGA来开发一个 数字跑表，实现跑表的全部功能
评级：0 浏览量：53 收藏量：0 资源大小：51KB 上传时间：2022-09-24

: 74LS160数字跑表基于74LS160的数字跑表，能实现百分秒0-99，秒，分的计时，外加启动/暂停，清零电路。
评级：0 浏览量：320 收藏量：6 资源大小：209KB 上传时间：2015-05-30

: 西科大FPGA实验2数字跑表代码全部包括divider_module,计数模块，led_out以及top层代码，能直接使用，后续实验代码持续更新中。。。
评级：5 浏览量：324 收藏量：6 资源大小：3.9MB 上传时间：2022-04-12

: verilog 数字跑表代码用verilog HDL编写的一个具有“百分秒、秒、分”计时功能的数字跑表，可以实现一个小时以内精确至百分之一秒的计时，注释比较清晰，容易看懂，还可以增加小时的计时功能
评级：0 浏览量：620 收藏量：1 资源大小：2KB 上传时间：2018-01-29

: vhdl数字跑表程序 vhdl中数字跑表实用程序，简洁明了，印象深刻
评级：0 浏览量：250 收藏量：2 资源大小：256KB 上传时间：2012-09-24

: 基于FPGA的数字跑表设计.pdf 基于FPGA的数字跑表设计.pdf
评级：0 浏览量：403 收藏量：0 资源大小：2.75MB 上传时间：2021-07-13

: verilog 实现数字跑表 如果你是肥大学子，在做verilog课程设计，不用再看了，这就是你需要的！...功能描述：此数字跑表由三个按键控制，按键功能如下： SW1：实现暂停、开始以及数据的保存 SW2：实现清零 SW3：实现已保存数据的显示
评级：4 浏览量：239 收藏量：1 资源大小：721KB 上传时间：2011-05-31

: 基于fpga的数字跑表代码设计代码
评级：0 浏览量：185 收藏量：0 资源大小：38KB 上传时间：2021-06-18

: paobiao.zip_FPGA 数字跑表_stopwatch FPGA_数字跑表 数字跑表，包含百分秒、秒、分，能在FPGA上下载并显示
评级：0 浏览量：82 收藏量：0 资源大小：1KB 上传时间：2022-09-14

: paobiao.rar_ISE 跑表_数字跑表_跑表 ise ISE仿真平台下建立的用verilog语言实现的简易数字跑表工程
评级：0 浏览量：42 收藏量：0 资源大小：162KB 上传时间：2022-09-21

: 用FPGA实现数字跑表功能利用VerilogHDL语言在FPGA开发板上面实现利用数码管显示0到99的跑表功能。
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: 基于原理图的数字跑表设计课程设计基于原理图的数字跑表设计课程设计
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: VHDL语言设计数字跑表的源代码 VHDL语言设计数字跑表的源代码，通过VHDL语言实现数字跑表的功能
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: 数字跑表6位数码显示Multisim源文件,Multisim13以上版本可打开运行.zip 数字跑表6位数码显示Multisim源文件,Multisim13以上版本可打开运行
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: EDA数字跑表设计基于eda的一个数字秒表的设计，包括部分仿真结果，和全部的vhdl源程序
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: verilog数字跑表 verilog数字跑表建模仿真验证包含代码和详细分析
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: FPGA数字跑表.doc FPGA数字跑表.doc
评级：0 浏览量：69 收藏量：0 资源大小：549KB 上传时间：2021-10-07

: 基于CPLD的数字跑表课程设计 EDA（Electronic Design Automation）电子设计自动化技术...CPLD即复杂可编程逻辑器件，早期CPLD是从GAL的结构扩展而来，但针对GAL的缺点进行了改进，因此可用于各种现实生活中的应用，比如说本次课程设计数字跑表。
评级：0 浏览量：499 收藏量：4 资源大小：569KB 上传时间：2011-06-24

: 数字跑表课程设计论文 数字跑表是人们日常生活中比较常见的工具，应用也比较广泛。本课题的主要内容是用AT89C51单片机为核心，配备7段数码显示模块等功能模块设计一款数字跑表，要求用数码管可以显示百分秒、秒、分，具有暂停\启动功能和...
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: 采用verilogHDL编写的数字跑表 本代码采用verilogHDL编写，实现的是数字跑表功能
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: paobiao.rar_stopwatch_数字跑表_秒表暂停_秒表暂停复位实现数字跑表功能，该跑表具有复位、暂停、秒表计时等功能。
评级：0 浏览量：74 收藏量：0 资源大小：472KB 上传时间：2022-09-19

: 课设作品，数字跑表设计，功能完美实现-电路方案 数字跑表的核心部件是计数器，给出合理的时钟脉冲从而实现最低位的计数以及对高位的进位。时序脉冲源由555定时器构成的多谐振荡器，设置特定的参数可以产生频率为100Hz的时序脉冲，为计数器提供时序脉冲，使之进行...
评级：5 浏览量：461 收藏量：2 资源大小：1.35MB 上传时间：2021-04-20

: 百分秒数字跑表，数码管显示 数字跑表具有复位、暂停、秒表计时等功能。3个输入端为时钟输入（clk）、复位（clr）、启动与暂停（pause）按键。
评级：0 浏览量：416 收藏量：3 资源大小：485KB 上传时间：2014-07-03

: Verilog HDL 数字跑表 verilog HDL 数字跑表 源程序适用于 verilog HDL初学者 verilog HDL 数字跑表 源程序也可以用于课程设计
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: 7.EDA程序设计--数字跑表.rar 要求： 1．具有暂停/启动功能； 2．具有重新开始功能； 3．用6个数码管分别显示百分秒、秒和分钟。
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: 基于VHDL的数字跑表技术.doc 基于VHDL的数字跑表技术.doc
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: 数字跑表设计工程文件.zip 数电课设从仿真到AD原理图pcb再到VERILOG程序
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: 基于FPGA数字跑表的设计说明.doc 基于FPGA数字跑表的设计说明.doc
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: FPGA.zip_FPGA 乘法_FPGA 乘法器_fpga加法器_stopwatch FPGA_数字跑表 fpga的加法器，乘法器代码，很全面，还有数字跑表，状态机，自动售货机等一些编码
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: 数字跑表的Verilog实现在ISE开发环境下用Verilog语言写的数字跑表代码且包含所有工程文件。
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