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xilinx平台DDR3设计教程之仿真篇_中文版教程 评分:

xilinx平台DDR3设计教程之仿真篇_中文版教程
2014-12-06 上传大小:20.85MB
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评论 共8条

cynthia2003 资源不错,谢谢楼主
2016-08-11
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luohuajiexiejuan 不错的资源
2016-06-20
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dengkkk 还可以,很多资源内容都是一样的
2016-05-08
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headforever 这个资料好。比较齐全。
2016-04-29
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qq_16797773 这个好 一步一步教你 真的不错 !
2016-01-20
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u010830004 非常具体,而且文档写得幽默
2016-01-08
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zuicao123 挺不错的,谢谢分享。
2015-12-25
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u014687438 DDR3设计指导很实用,谢谢。
2015-09-01
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vivado仿真ddr3读写模块
现在ddr3的仿真测试怎么做??
Modelsim实现对Vivado中的MIG ddr3的仿真
Xilinx MIG DDR3 控制器 Modelsim 仿真
vivado2016.2下系统自带DDR3 ip例程仿真运行
Xilinx基于MIG IP Core的DDR3设计【1】 -- 建立仿真平台
xilinx平台DDR3设计程之应用篇_中文版教程

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xilinx平台DDR3设计程之高富帅篇_中文版教程.pdf

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xilinx平台DDR3设计程之仿真 综合 设计 应用 高富帅篇

xilinx平台DDR3设计教程之仿真 综合 设计 应用 高富帅篇,包含了总共5个pdf文档

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Xilinx平台DDR3设计教程

包含 Xilinx平台DDR3设计教程四个文档:设计篇、仿真篇、综合篇及高富帅篇。

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FPGA(XILINX) DDR3 内存条 读写测试 仿真通过 (VIVADO 2015.2)

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xilinx fpga ddr3数据读写工程

该资源为ddr3数据读写代码工程,由vivado2018.2编写。低版本的软件请参考附带的教程,自行配置ip核。开发板为ax7035,芯片为xc7a35tfgg484,ddr3芯片为16bit位宽,直接上板使用,其他芯片需更改相关输入输出管脚。module文件代码量少,适合初学者了解ddr3的读写操作。

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XILINX DDR3 IP核使用教程完整版

网络下载的XILIN DDR3 IP核教程,包括仿真、综合、设计、应用、最终篇5个部分,讲解的深入浅出,简明扼要,非常实用!在其指导下,完成了DDR3的设计调试!可惜没有找到出处!

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自己编写的xilix ddr3 IP核用户接口verilog程序

官方给的ddr3测试程序长达万行,有木有很痛苦的感觉?来来来,这个测试接口只有300行左右,实现了顺序写入及顺序读出,可以让你在半个小时之内了解具体的实现方法,本程序在ml605及ise14.4的ddr 3.92上验证过,可以正常读写,但仍然有bug,只是提供一个思路哈,我也在努力继续改进。

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基于MIG的DDR3读写测试电路Vivado工程已上板测试

自己编写的基于MIG IP核的针对DDR3的读写测试电路,非自带的示例工程,可用于快速熟悉MIG用户接口的时序关系及使用方法。压缩包内为Vivado工程,已成功上板调试。附带testbench,tb里包含有DDR3仿真模型及wiredelay模块的使用方法,仅供参考。

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xilinx ddr3设计详解

有关XILINX平台上DDR3设计的资料,讲解的比较详细

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黑金FPGA教程(数学篇)

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XILINX平台DDR3设计教程

从零开始的Xilinx DDR3 控制程序编写教程,利用MIS IP核通过自编逻辑实现对DDR3的读写

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DDR3相关的两个小资料,分仿真和综合两个文件,里面有比较详细的步骤,分享出来大家学习一下,2个积分意思一下,希望大家学习愉快

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